大家好、
我有一位客户使用 UCC28056并尝试调整谷底开关点。
根据第8.3.3.1节的规定、只需通过 Rdg 进行设置、但是、扫描所有 R 值不会导致延迟方面的任何有用差异(请分别参阅下面的图像、了解 R = 160K 和9K)。
它们使用的是 ST 500V FET (STB28NM50N) https://www.st.com/resource/en/datasheet/stb28nm50n.pdf
我可以通过电子邮件共享原理图。
您能帮助我们制定解决方案吗?
谢谢、
Kevin
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大家好、
我有一位客户使用 UCC28056并尝试调整谷底开关点。
根据第8.3.3.1节的规定、只需通过 Rdg 进行设置、但是、扫描所有 R 值不会导致延迟方面的任何有用差异(请分别参阅下面的图像、了解 R = 160K 和9K)。
它们使用的是 ST 500V FET (STB28NM50N) https://www.st.com/resource/en/datasheet/stb28nm50n.pdf
我可以通过电子邮件共享原理图。
您能帮助我们制定解决方案吗?
谢谢、
Kevin
你好。
我查看了数据表、正确的是、选择 Rdg 会设置 CS/ZCD 检测到零电流时的开启延迟。
您可以设置 TZCDR0到 TZCDR7的延迟。 请注意、延迟为 TZCDRO +deltaTZCDRx。 如果您选择的 Rdg0为130K、则最短时间为170ns。 因此、如果您选择 RDg1、则延迟将为170ns + 45.5ns = 215ns。 请参阅数据表的第5页和第7页、了解如何选择电阻器。
如果它们尝试获得小于170ns 的延迟、则无法实现。 如果延迟大于170ns、则应可以对其进行调整。
您可能还需要使用 Excel 设计工具检查两个 ZCD/CS 滤波器的设置。 您可以在以下链接中找到该工具。
此致、
尊敬的 Mike:
我不确定我共享的波形是否可见。 我通过 Word 文档附加了该文档。
客户知道如何选择电阻器。 问题是当它们选择任一极端值(9K 与160K)时、延迟没有真正的差异。
在波形中、您可以看到 Vds 相当高(不在谷底)时它会切换。 有什么想法、有什么问题吗?
此外、它们还使用 UCC28056常规版本(而不是 B 或 C)。 如果它们使 ZCD 电容为22pF、它们会注意到它在谷底开关方面看起来更好、但电流波形会产生噪声。 如果它们增加这个 ZCD 电容器、电流看起来会更好、但它们会失去它们之后的软开关。