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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/921966/tps3824-operation-of-reset-pin-when-vcc-is-stable-of-tps3824
您好！
当 VCC 稳定时、我会对运行情况产生一些困惑。 我已尝试通过附加的媒体解释我的理解。
因此，根据我的理解，如果我要将我的 RESET (bar)引脚连接到逻辑'1'，我必须在 T < TT (out)[看门狗超时]时，每 T 间隔连续应用100ns 的 WDI 输入(脉冲)。
如果我在这方面遗漏了任何东西、请告诉我。
您好、Akshay、
TPS3824的工作方式是、您必须在看门狗计时(典型值为1.6秒(最小值为0.9秒)之前提供至少100ns 宽(可以宽得多)的上升或下降信号 否则、在200ms 的复位延迟时间内将发生/RESET 向逻辑低电平的转换。 这是您看到的行为吗？
