[参考译文] TPS3820：复位引脚现象

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/769155/tps3820-phenomenon-for-reset-pin

器件型号：TPS3820
主题中讨论的其他器件： TPS3823、 TPS3828、 TPS3824

您好！

我发现复位引脚出现意外现象。

看门狗超时+延迟时间后、RESET 引脚不会设置为高电平。
2.在#1之后、复位引脚在 WDT 停止后30ms 设置为高电平。

从数据表信息来看、这两种现象似乎都是意料之外的。

我准备了文件。请为其提供支持吗？

e2e.ti.com/.../TPS3820_5F00_questions.xlsx

此致、
Nagata。

5 年多前

0 admin 5 年多前

TI__Guru**** 1142300 points

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Nagata、

为什么在/RESET 输出端使用上拉电阻器？ TPS3820为推挽式输出类型、因此请勿使用上拉电阻器。您能否确认移除上拉电阻器时问题是否仍然存在？

Michael

0 admin 5 年多前

TI__Guru**** 1142300 points

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大家好、Michael、

我将在没有上拉电阻器的情况下检查工作情况。
BTW、您对下面的问题是否有疑虑？

a) nRESET 置为有效(设置为低电平)后、器件在 WDT 输入恢复后需要多长时间(？ms)才能使 nRESET 失效？
->我想、应该重新考虑数据表中的 TD 时间(典型值25ms)。正确吗？

b)即使 WDT 的输入被恢复、也有可能发生 nRESET 保持低电平吗？

此致、
Nagata。

0 admin 5 年多前

TI__Guru**** 1142300 points

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Nagata、

a)是的、您答对了、故障条件消除后、/RESET 引脚在 TD 下保持低电平。这称为复位延迟。
b)如果器件处于/RESET 低电平有效状态、并且在复位为低电平期间有一个 WDI 信号到达、则复位将保持低电平、直到电源关闭后再重新打开。唯一不以这种方式锁存的器件版本是 TPS3823A 的版本 A 器件。您还可以使用 FET 对信号进行去耦、或在复位低电平有效状态下不提供 WDI 信号。

请参阅数据表的第8.3.4节：

'在 WDI 引脚输入有效(转换为高电平和低电平)且 TPS3820、TPS3823、TPS3824或 TPS3828将 RESET 置为有效的应用中、在输入电压恢复到高于 VIT–后、RESET 卡在逻辑低电平。如果应用要求 WDI 的输入在复位信号被置为有效时有效、那么应该使用器件的 A 版本或者一个 FET 来去耦 WDI 信号。如果在复位被置为有效时接收到一个 WDI 脉冲、A 版本不会将复位信号锁存在状态。当复位被置为有效时、一个外部 FET 通过断开 WDI 输入来去耦 WDI 信号。'

如果您有任何其他问题、请告诉我。谢谢！

Michael

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