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[参考译文] TPS259241 EN 信号上的干扰问题

Guru**** 2345050 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/631024/tps259241-glitch-issue-on-en-signal

大家好、

请在下面找到具有活动组件配置的方框图:

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    您好 Anandraj、

    您的附件似乎丢失了

    此致、
    Rakesh
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    您好、Rakesh、

    感谢您的回复。忘记附上方框图和捕获的波形。

    请查找无源组件值如下的方框图:

    捕获的波形

    我们将面临 EN 信号上的干扰问题。

    为什么 EN 信号上会出现 EN 干扰?如果有人遇到类似问题、请告诉我如何解决。

    谢谢、此致、

    Anandraj.S

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    您好 Anandraj、

    干扰来自 EN 引脚上提供的 OTP 选项/部分。 当输入电压达到其内部 UVLO 阈值时、所有配置位均已正确设置、这就是导致此干扰的原因。 在达到内部 UVLO 之前、EN 引脚上有~500kΩ Ω 的上拉阻抗、一旦越过 UVLO、该阻抗就会消失。 它对系统中部件的行为无害。

    此致、
    Rakesh
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    感谢您的回复。

    我明白你的观点。 但是、我仍然希望 避免 EN 引脚上的干扰、是否存在?

    R2的另一个观察结果是打开:

    当 R2打开时、EN 引脚上未出现毛刺脉冲。 为什么?

    谢谢、此致、

    Anandraj.S

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    您好 Anandraj、

    仅当放置 R2时、它才会在 EN/UVLO 引脚上形成具有内部阻抗的分流器。
    可以通过将 R1和 R2按系数10或更高进行缩放来减少干扰。 在本例中、请检查 R1 = 100k Ω、R2 = 14.7k Ω

    此致、
    Rakesh
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    感谢您的回复。

    我们已经更改了电路板中的 R1 = 100K 和 R2 = 19K6、现在干扰减少了。

    根据数据表、欠压锁定设定点公式如下:

    VUV=((R1+R2)*VENR)/R2 ,其中 VENR=1.4V

    在 下面配置(R1 = 100k;R2 = 19K6;VENR =1.4V)时捕获的波形:

    欠压设定值(VUV)的理论值= 8.542V、但测量值为9.72V。

    为什么欠压设定点的理论值(8.5V)和测量值(9.72V)不匹配?

    2. EN 引脚上的建议最大电流?

    3.请建议以下配置的值:

    Vin = 12V;

    欠压设定点 VuV=10V。

    电流限制热销限制= 3.7A

    设置输出斜坡时间= 2.6ms

    r1=?;r2=?;CdVdT=?;RLIM=?。

    谢谢、此致、

    Anandraj.S

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    您好 Anandraj、

    当输入电压大于 VUVr (8.54V)时、器件将启用、但输出仅在 Ton 延迟后才会开始上升。

    请使用 www.ti.com/.../toolssoftware 上提供的设计校准 、如果您有任何疑问、请告诉我。 数据表中有两个应用示例。

    此致
    Rakesh
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    感谢您的支持。

    对于设计参数、我们可以使用该 Excel。

    在该 Excel 中、没有提到 EN 引脚最大电流。

    请告诉我 EN 引脚上的最大电流。

    此致、
    Anandraj.S
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    您好 Anandraj、

    当 R2未使用时、应选择足够高的 R1、以将流入 EN 引脚的电流限制在20uA 以下

    此致、
    Rakesh
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    感谢您的支持

    谢谢、此致、

    Anandraj.S