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[参考译文] TPS7A49：轻负载条件下的输出电压较高

admin
Guru**** 2350340 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/616263/tps7a49-output-voltage-high-for-light-loads

器件型号：TPS7A49

我的客户   正在设计中使用三个 TPS7A4901器件。 其中两个设置为10V 输出、另一个设置为3.3V。 10V 输出没有问题。 但它们在3.3V 输出方面存在一些问题。 对于空载、输出大约为9.7V、而不是3.3V。 它在开环条件下工作。

 

但是 、当它们放置一些虚拟负载、例如13.7K 欧姆@3.3V 输出时、输出为6.8V。 将虚拟负载增加到1KOhm、我们可以获得3.3V 输出。

 

使用分压电阻时不应存在最小负载(请参阅所附的原理图)、对吧？

 

这里还会发生什么情况？

 

顺便说一下、我让他们把 Cin 增加到2.2 μ F、没有改善。

 

谢谢！

 


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    TI__Guru**** 2350340 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Allen、

    这似乎是由于流经导通晶体管的泄漏电流而发生的。 如果降低 Vin、则应使用更小的负载电流来防止输出漂移。

    另一个需要检查的问题是其他泄漏路径(如焊剂)。 如果有额外的电流流入 FB 节点、这些泄漏路径会导致输出漂移更高。

    此外、请记住、输入上的2.2uF 是建议的电容值、因此考虑到直流降额、电容器需要更大。

    此致、
    标记
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    TI__Guru**** 2350340 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Mark、您好！

    降低 Vin 将不是他们的选择。 该器件的额定输入电压为36V。 是否存在最大输入电压差值以防止此导通 FET 泄漏？ 我们可以采取什么措施来降低流经导通晶体管的泄漏电流？ 或者它们是否只需要添加外部负载？

    谢谢！
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    TI__Guru**** 2350340 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Allen、

    首先要尝试的是使用焊剂清洁剂清洁电路板。 如果这不起作用、则必须在器件上施加恒定负载、以防止输出上升。

    此致、
    标记