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[参考译文] 为何高阻抗节点容易拾取噪声?

Guru**** 2442090 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/663816/why-high-impedances-node-are-susceptible-to-pick-up-nosie

尊敬的 TI 工程师:

    当我阅读文档“用于降低 EMI   的非隔离式电源布局设计”时,我混淆了高阻抗节点容易拾取噪声。 许多文章也说了同样的意思,但没有一篇文章解释 了原因。所以,请告诉我  这个原则,非常感谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好、Yongxue、

    使用从反馈电阻器到 FB 引脚的长反馈走线对电路板进行布局时会遇到的问题是、FB 引脚容易受到快速 dV/DT 开关和/或快速 dI/dts 导致的电容耦合的影响。 您可以创建两个节点、两个节点之间的距离较大、一侧具有高阻抗。 通过将 FB 电阻器放置在靠近 FB 引脚的位置、FB 走线被保持在非常短的位置、从而最大限度地减少耦合到 FB 引脚的噪声、从而使其更加抗噪。


    如果噪声耦合到 FB 引脚、则输出可能会出现误差、或者在极端情况下、环路可能会出现不稳定的情况。

    对反馈电阻器进行布局时、请确保 FB 电阻器靠近器件、并将 Vout 感应路由到最接近负载的点、从而避免在将布线路由到上述点时出现任何噪声节点。

    希望这对您有所帮助?

    David。
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    您好,David:

    感谢您的回复!我理解您所说的“FB 引脚容易受到快速 dV/dt 开关引起的电容耦合 ”。 在  我的意见中,,耦合电容器和高阻抗节点构成了一个高通滤波器,从而使噪声易于耦合。我的意见是否正确?

    我仍有以下两个问题需要 与您讨论。

    (__LW_AT__1)您提到了电感耦合。但我不太理解电感耦合的原理、请进一步解释。它是如何传导到高阻抗节点的?

    (__LW_AT__2 μ),据我们所知,噪声包括耦合噪声(或传导 噪声) 和辐射噪声。 但是,高阻抗节点如何能够轻松拾取辐射噪声?根据 PCB 布局原理、这意味着如果其中一个节点的阻抗较低、 则辐射噪声 不容易拾取,Ω、为什么?Ω

    期待您的回复、并希望您理解我的意思。 非常感谢。

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    电感耦合是两个电流发生变化的导体、产生耦合到相邻导体的磁场。 如果您具有高阻抗、那么更多的噪声将耦合到节点上、如果是低阻抗。

    请参阅下面的链接。

    en.wikipedia.org/.../Inductive_coupling



    这会导致您的第二个问题、是的、阻抗越高、它就越容易因噪声而损坏。

    希望这对您有所帮助?

    David。
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    大家好、David:

    感谢您的回复。我还有两个问题要与您讨论。

    Q1:我了解电感耦合的机制、但我不了解电感噪声如何影响 FB 节点。 我认为、由于存在布线(两种方式)、快速 DI/DT 会产生与反馈布线耦合的不断变化的磁场、从而在电源输出端和反馈电阻器之间产生电感电压噪声。 因此、在布局过程中尽量减小 FB 节点和误差放大器之间的距离的目的仅在于降低因分压而进入误差放大器的噪声。 这两种布线类型都会产生电感耦合噪声。 我的理解是否正确?

    问题2:

    关于辐射噪声、在我看来 、辐射噪声是通过在太空中接收电磁波而产生的。 由于 FB 节点的电源输出是天线、因此可以吸收辐射噪声。 由于天线接收到的能量会产生电流、如果两侧都是高阻抗、则噪声相对较大。  如果一侧为高阻抗、另一侧为低阻抗、则噪声很小。  因此、接线要求会尽量减小高阻抗节点之间的距离。 是这样吗?

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    您好!

    我看它的方式如下。  如果您的电阻器具有相对较低的 Z、并且您通过较长的布线长度(创建电感路径)连接到高 Z 节点、则表示您在考虑的开关频率下创建了高 Z。  如前所述、高 Z 节点更容易受到噪声拾取的影响。

    希望这对您有所帮助?

    David。