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[参考译文] UCC28950:UCC28950同步信号设置问题

Guru**** 2390735 points
Other Parts Discussed in Thread: UCC28950
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/689303/ucc28950-ucc28950-synchronization-signal-setup-problem

器件型号:UCC28950

大家好、

一位客户使用 UCC28950设计48V 输入、12V 输出和35A 最大输出电流的电源。 将时钟频率设置为400kHz、即开关频率为200kHz。 本设计中使用平面变压器和电感、初级 MOSFET 和整流器 MOSFET 均采用 TI 的 CSD19534封装、可承受100V 的电压。

1、 在加入同步整流之前、将整流器 MOSFET (全波整流)替换为肖特基二极管、并严格减去 ZVS 参数、由于肖特基二极管的最大电流限制、 最大输出电流为6A。 在轻负载条件   下、测试结果看起来稳定、高级 ARM 完全实现 ZVS、而后臂未完全实现 ZVS。

2.在肖特基整流器条件  下、空载输入电流为20mA;2A 负载时的效率为86%。 输出电压纹波小于1%。 CCM 和 DCM 的关键输出电流为3.5A。 当输出电流达到4.4A (完全进入 CCM)、同步信号路由和 OUTF 被启用时、次级侧驱动器为 LM5111-1、输出稳定。

3.将 schottke 替换为 CSD19534 (两个 CSD19534并联、无 RC 吸收电路)。 当输出电流增加到2.7A 时、输出整流器击穿电压的4个 MOSFET 以及 G、S 和 D 均短路。 恢复肖特基整流管后、当电路在无负载的情况下启动时、可以找到输出电压、而当电路在0.1A 负载下启动时、输出电压为零。 因此、初级侧可能有一些器件损坏。

UCC28950同步设置如下:

RAEFHI 不会安装、这意味着 CS 和 ADELEF 以 断开方式;RAEF 设置为0、即 ADELEF 引脚接地。我们分析同步信号与 CS 无关、 但它们是否需要相关?数据表不清楚。查看参考设计 RAEFHI 通常为几兆欧姆。

问题:上述分析是否合理? 是否必须安装 RAEFHI? 或者还有其他原因吗? 最好给出原则。谢谢

此致!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Lenna

    如果您不想使用同步整流器(SR)上的自适应延迟功能、则不必安装 RAEFH、将 ADELEF 连接到 GND 是正确的做法。

    您如何并行连接 CSD19534器件? 您至少需要单独的栅极驱动电阻器-每个 MOSFET 一个电阻器。 并联 MOSFET 可以极高频率(>100MHz)振荡、单独的栅极电阻器和具有最小源电感的精心布局有助于防止这些振荡。

    一个建议是在仅连接4个 SR MOSFET 中的2个的情况下运行您的 PSU -这样可以避免与 MOSFET 的并联运行相关的问题。

    可以在不使用自适应延迟的情况下运行 SR -将初始 SR 延迟(Delef)设置为低值-很难说出正确的时间是多少、但要在 Delef 引脚上选择电阻器以设置100ns 的延迟 比 DELAB 引脚上的电阻器设置的延迟长200ns。 这应在次级电流从一个绕组转换到另一个绕组后、但在电流达到零或变为负之前关闭 SR。 您应该会看到一些体二极管导通、体二极管导通的持续时间会随着负载电流的增加而增加。 SR 上的自适应延迟(ADELEF)会增加 SR 关断前的延迟、从而最大限度缩短体二极管导通间隔。  请查看下面的图。

    一旦您可以让 SR 在没有自适应延迟的情况下运行、我就会添加自适应延迟功能、并获得延迟时间的第一遍解决方案。 然后、我将添加并联 SR 并完善自适应延迟功能。

    注意:如果您允许关断延迟过长、则 SR 电流可能变为负值-即、 从漏极到源极-如果 SR 以负电流关闭、您将在 SR 上看到明显的电压尖峰-这些尖峰会雪崩并破坏 SR。 因此、最好在开始时使用过短的 SR 延迟、而不是过长的 SR 延迟。

    此致

    Colin