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[参考译文] UCD3138064:有关:过采样和控制器延迟的问题

Guru**** 2454880 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/672563/ucd3138064-question-about-oversample-and-the-delay-of-the-controller

器件型号:UCD3138064

我想设计一个开关频率为200kHz 的降压转换器。 我希望闭环带宽达到30kHz, 我的 konw 有一个纯粹的滞后:e^(-j*w*Tdpwm),所以我认为我可以使用过采样 x8,但这是无用的。

那么 、您知道如何使用过采样吗?  怎么了???   纯滞后由开关频率决定? 如何在我的污垢带宽中不存在任何纯滞后的情况下操作系统?

此致

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    PID 滤波器从 EADC 采样到 DPWM 侧的占空比更新准备就绪的延迟约为500nS。

    您将样本触发器放置在何处? 您应该将其设置为4500 ns (周期结束前为500 nS)。

    这样、EADC 将在每个4500/8 = 562.5nS 间隔采样、这足以使滤波器能够处理和传播每个采样。

    但是、由于 EVENT_UP_SEL 设置为1、因此占空比在开关周期中仅更新一次。

    您的拓扑是什么? 在大多数拓扑中、我们建议将 EVENT_UP_SEL 设置为1。

    希望这对您有所帮助。

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    我在你的帮助下成功地完成了这项工作。非常感谢!
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    我也有疑问。 500nS 的延迟时间是否包括 eADC 的64ns 转换时间?

    此致。
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    是的、它包含转换时间。