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[参考译文] TPS7H1101-SP:增益和相位裕度帮助

Guru**** 2513185 points
Other Parts Discussed in Thread: TPS7H1101SPEVM, TPS7H1101A-SP

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1316154/tps7h1101-sp-gain-and-phase-margin-help

器件型号:TPS7H1101-SP
主题中讨论的其他器件:TPS7H1101A-SP、TPS7H1101SPEVM

为了获得更大的相位裕度(30度以上)、我需要在输出端添加12个330uF 电容器。  看似过度。  需要帮助来弄清楚如何得出这个数字。

谢谢。

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    您好、Joseph:

    您测试的电容器的 ESR 是多少? 这是在工作台上测量的仿真还是结果?

    该器件不需要较大的输出电容即可实现稳定性。

    谢谢。

    莎拉

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    大家好、Sarah、 ESR 是19.3mΩ、我平行划分了多少个 ESR。

    它是一个仿真而不是工作台。

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    感谢 Joseph、

    当我重新创建工作条件、但使用默认模型中的电容时、可以看到61度的相位裕度。 这与我们期望器件使用更合理的 COUT 值的情况一致。  

    使用电容器时(但将330u 降至仅1个电容器而非12个)、我仍然看到其 PM 为48度。 是否对显示 PM<30度的容差进行了分析?  

    无论如何、 由于存在 ESR 零点、交叉比默认原理图电容器仿真运行的结果要低得多。 如默认原理图中所示、降低总输出电容将有助于实现这一点。

    谢谢。

    莎拉

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    Sarah、是的、我正在使用您在我的原理图中看到的容差执行 Monte Carlo 计算。  均匀分布导致 Gaussian 看起来很糟糕。  500次运行。  为了保持在30度以上、我需要12个330uF 电容器。  另请注意、与 Rbottom 并联的电容器确实有一定帮助。  我想违反我们的30度要求、并指定该器件无法满足我们对输出电容器等具有如此大容差的要求。

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    感谢确认 Joseph。 您能说明 ESR ~90%容差的来源吗? 这是导致结果出现变化的关键因素、而不是器件本身。

    更现实的做法可能是、将每个电容器(和寄生 ESL/ESR)单独放置在原理图上、而不是在运行容差仿真时将它们组合在一起、以便仿真器可以随机地分别变化、而不是假设每个电容器都是12个330uF (例如) 它们都具有完全相同的变化量。

    当我以均匀分布和使用容差的单独 COUT 电容器执行500次仿真时、我观察到的最低 PM 为39°。 鉴于这是均匀分布而不是高斯分布、我也预计该结果比大多数情况更加悲观。  

    谢谢。

    莎拉

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    听起来唯一的差值可能是 PSpice 模型。  您是否正在使用这一个。。。

    * TPS7H1101A-SP 最坏情况分析(WCA)模型

    *(C)版权所有2021德州仪器(TI)公司。 保留所有权利。

    **此型号被设计用于为德州仪器的客户提供帮助。
    ** TI 及其许可方和供应商不作任何明示或
    ***或暗示,对于本型号,包括担保
    **适销性或特定用途的适用性。 该模型是
    **完全按"现状"提供。 质量的全部风险
    **性能取决于客户。

    *
    *此型号如有变更,恕不另行通知。 德州仪器(TI)
    *公司不负责更新该模型。
    *

    *
    *发布者: Texas Instruments Inc.
    *部件: TPS7H1101A-SP
    *日期:2021年9月17日
    *模型类型:最坏情况分析
    *仿真器: PSpice
    *模拟器版本: 17.4.0
    * EVM 订单号:TPS7H1101SPEVM
    * EVM 用户指南:SLVU944B â€" 2020年10月修订
    *数据表:SLVSDW6C â€" 2021年4月修订
    *型号用户指南:SLVUBT7A - 2021年4月修订
    *
    *型号:版本 C
    *

    *
    *更新:
    *
    *最终1.00
    *发布到网络
    *
    *修订版 A/B - 2021年4月
    * 1. 将文件更改为 Windows CRLF 而不是 Unix LF 并添加了 TPS7H1101A-SP_WCA
    *子电路名称添加到。 Ends 语句以避免可能出现的错误消息
    *至。 Ends 语句
    * 2. 在库文件中添加了缺失的 TI 标头
    * 3. 将器件子电路名称更新为"TPS7H1101A-SP_WCA"而不是"TPS7H1101A-SP"
    * 4. 更新了器件子电路引脚顺序、使器件符号更方便
    * 5. 更新模型以使用 GND 引脚、而不是直接连接到0V 节点、
    *与此相关
    *
    *修订版 C
    *暂时重新发布原始版本。
    *

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    Sarah 您还可以发送一些仿真设置的屏幕截图吗?

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    不幸的是、ESR 的容差是我的程序的要求。  我确实想尝试和放松,但听起来我可能不需要,如果你的仿真(这是"相同的"我的)是通过.

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    此外、我在分离无源器件后重新进行仿真(与将它们集中在单个符号上相比)、似乎在仿真中没有太大区别。  您是否注意到它对您的业务有何影响?

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    尊敬的 Joesph:

    我将随附已存档的项目文件、以便您 确切看到所看到的内容。 我在整个通信过程中一直使用相同的仿真设置。  

    e2e.ti.com/.../tps7h1101a_2D00_sp_5F00_wca_2D00_2024_2D00_01_2D00_25.zip

    我决定看看 ESR 值的极端结果导致了最小相位裕度的情况。 看起来具有最低 ESR 的仿真运行会导致最低的相位裕度。 为了满足 ESR 容差要求、一个可能需要解决的问题是只需添加一些串联电阻。 这对您来说是可行的解决方案吗?  

    如果您想自己快速查看结果、我目前将此方法设置为默认原理图和仿真配置文件。  

    谢谢。

    莎拉

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    完美!  谢谢!