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[参考译文] TPS274160:对器件进行 PWM 处理有可能会触发 FAULT 引脚

Guru**** 1646690 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1293219/tps274160-there-is-a-chance-that-pwming-the-device-will-trigger-fault-pin

器件型号:TPS274160

当我使用250Hz PWM 驱动芯片的 EN 引脚时、有机会触发 FAULT 引脚、不确定是哪个故障。

但是、如果我动态更改占空比、机会会高得多。 即、将亮度从调光更改为100%。

它是在存在或没有负载的情况下发生的。 我认为这款芯片支持 PWM 吗?

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    您好!  

    我们的高侧 开关支持 PWM、但请注意、它们并不用于高于2kHz 的 PWM 应用。  

    您能否确认您正在使用该器件的版本 B 并且 DIAG_EN 处于高电平?  

    器件可能会出现过载情况、反极性事件、热关断或热摆动。  

    您能否提供一份原理图、以便我能够确认您的电流限制? 此外、还请提供 VS、VEN、FAULT 和 IOUT 的波形?  

    此致、  

    伊丽莎白

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    很抱歉耽误你的时间、

    我使用的版本将 DIAG_EN 连接至3V3以实现始终启用。

    我被误解为当我的意思是 FAULT 引脚实际上是被触发的 ST 引脚时。

    当对其进行 PWM 时、ST 引脚将在 PWM 的下降沿后被触发。

    输出未被中断。

    (上述故障实际上是 ST 引脚)

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    尊敬的 Weiwei:  

    感谢您提供这些波形! 如果 VOUT 波形被 ST 图覆盖并进行放大、我会更为好奇。  

    由于 ST 被拉至低电平时 EN 为低电平、触发 ST 低电平的条件必须是开路负载。  

    我怀疑 ST 被拉低是 因为输出上的一些电容将输出保持得足够高、以至于 VS-Voutx <V (ol、off)条件在您看到 ST 被拉至低电平的~2ms 内保持真值。  

    我建议降低您的输出电容、在输出上添加一些下拉电阻、或通过软件忽略干扰。  

    此致、  

    伊丽莎白