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[参考译文] TPS1641:瞬态负载下电子保险丝关断

Guru**** 2589245 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1288176/tps1641-e-fuse-turning-off-with-transient-load

器件型号:TPS1641

您好!

我们使用的设计使用 TPS16412 IC。 我们具有瞬态负载、可将电流在115mA 与450mA 之间切换。  

我们对电子保险丝的电压要求是26V、而在 OVP Pinn 上、通过电阻分压器设置的电压为1.37V。

ILIM 设置为600mA、IOCP 设置为1A。

当我们使用恒流状态下的负载时、电子保险丝非常好、但当将其用作瞬态负载时、电子保险丝将关闭。

可能是什么问题

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    尊敬的 Rohit:

    感谢您考虑我们的器件。  

    IN 到 OUT 短路检测功能可能会随瞬态负载触发。 请使用 TPS16416型号来克服这一问题。  

    有关背景信息、请参阅数据表中的相应部分、并告知我们

    此致

    勒凯什

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    您好、Rakesh、

    感谢您的答复。

    TPS16412中是否有任何选项可绕过输入至输出短路检测? 我们将检查 TPS16412、以使其在我们的设计中正常工作;因此也是一个难题。

    此外、我们可以看到、只要 VCC 和 VIN (两者均来自同一电源(即26V)、FLT#就始终置位为低电平。 即使 EN 为高电平或低电平也是如此;但即使在此时 TPS16412仍能按预期工作、除非在瞬态负载下进行了测试。 附加原理图部分供您参考

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    尊敬的 Rohit:

    遗憾的是、 TPS16412中没有外部选项来绕过输入至输出短路检测。

    让我检查一下 FLT#问题并返回。 您能否使用 FLT#引脚上的100kΩ 上拉电阻器再次测试并确认 FLT# 问题。

    此致、

    勒凯什

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    尊敬的 Rohit:

    您是否 使用 FLT#引脚上的100kΩ 上拉电阻器进行了测试?

    此致、

    勒凯什

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    您好、Rakesh、

    将上拉电阻更改为100K 后、未观察到变化。 当我们将 TDD 信号馈入并导通后、电子保险丝

    我们在改变 Riocp、Rilim 和 Cidly 时有一些其他的观察结果,如下所示。

    案例1:Riocp - 16.2K

            Cidly - 0.01uFuF

            Rilim - 16.2K

            观察结果: 发送 TDD 信号后、电子保险丝关闭。 请确认这些引脚对瞬态负载是否有一些影响              在这些部件中进行细微调整、其中在给定电流开关的情况下可提供不同结果、该结果完全处于 ILIM 中。

    案例2:Riocp - 16.2K

            Cilled - 0.01uF

            Rilim - 16.2K

            Cdvdt - 220uF

            观察结果: 电子保险丝一直工作到20分钟 ,仍然没有起飞。 我们正在进行相同的多次迭代、并将在每次迭代时

    目前邮件问题与 FLT 引脚状态有关、它仅仍然为低电平、但电子保险丝工作正常。 您能对此作出评论吗?

    如前所述、我们的用例是向我们的输出功率放大器提供26V 输入电压。 我们的输出总线电容仅为大约30uF。 我们的操作是 TDD 操作、其中的工作频段为3.55GHz 至3.7GHz、占空比为75%、即考虑的功率放大器将在每个周期的75%内工作。

    请考虑这些测试案例并提供如何推进的建议。  

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    尊敬的 Rohit:

    1.没有负载时、TPS16412工作正常? FLT 引脚正常吗?

    2.施加负载后,FLT 是否保持低电平?

    此致

    G·库纳尔

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    您好、Rakesh、

    在这两种情况下、FLT 状态都是

    但通过将 dVdT 电容器更改为220nF、可以很好地工作。

    现在、唯一的问题是 FLT 引脚状态

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    尊敬的 Kunal:

    请检查一下。

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    尊敬的 Rohit:

    1.请分享负载仅为电容性负载而无下游负载时的波形。 请探测、VIN、EN、OVP、FLT、OUT。 FLT 处于低电平的一个原因可能是器件达到 TSD、而较大的 DVDT 电容器可降低浪涌电流以防止 TSD。  

    2.有一种 VOUT 正常但 FLT 低的情况? 还是始终在 FLT 为低电平时、VOUT 也消失了?

    2.另外、当您说发送 TDD 信号时意味着什么?

    此致

    G·库纳尔