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您好!
我的客户使用 SN75453BD、VCC = 5V、并在每个输入引脚上连接了下拉电阻(22k Ω)、以期望输出具有低电平。 不过、在输入引脚电压电平约为1.5V 时、输出为高电平。 您能告诉我原因是什么吗? 即使数据表未显示此类信息、它在每个引脚上是否有一个内部上拉电阻器? 我不认为会这样、但它是否依赖于封装?
此致、
川崎义和
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您好!
我的客户使用 SN75453BD、VCC = 5V、并在每个输入引脚上连接了下拉电阻(22k Ω)、以期望输出具有低电平。 不过、在输入引脚电压电平约为1.5V 时、输出为高电平。 您能告诉我原因是什么吗? 即使数据表未显示此类信息、它在每个引脚上是否有一个内部上拉电阻器? 我不认为会这样、但它是否依赖于封装?
此致、
川崎义和
您好、川崎三、
已了解-请参阅 数据表中的 IIL 参数、它是1.6mA 拉电流最大值。 为了将下拉电压保持在0.8V 以下、下拉电阻需要为0.8V/0.0016A = 500 Ω 而不是22k Ω。
如果客户希望具有更高的输入电阻、可以使用该器件的 NAND 版本 SN75451B、并使用上拉电阻器/低电平有效输入信号、因为 Iih 低于 IIL。
谢谢。
帕特里克
您好、川崎三、
是的、我同意您的分析。 但是、由于该器件在输入引脚上指定了-1.6mA 最大值、因此我的理解是、无论内部原理图如何、只要 IN 引脚输出的电流保持在1.6mA 以下、500欧姆电阻器就会将输入保持在 VIL 以下。 我建议客户尝试将22kOhm 电阻器更改为500欧姆、并探测引脚上的电压和电流 、看看他们是否发现自己有额外的空间来增加下拉电阻(如果选择的话)。
该器件很旧、专为直接 TTL/CMOS 输入连接而设计、因此下拉电阻需要比通常足够的强度更强。
如果我能为您提供更多帮助、请告诉我。
谢谢。
帕特里克