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[参考译文] UCC2897A:PMP5124 EVM 尖峰问题

Guru**** 2813875 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1247876/ucc2897a-pmp5124-evm-spike-issue

器件型号:UCC2897A

您好!

我们测试了开关相位、发现 PMP5124 EVM 板上的尖峰很高、有没有办法改善? 或者是否有任何建议?

在我们检查了 PMP5124 EVM 后、发现在断电模式下(Q3) VDS 高于 MOS 规格(>150V)有相同的问题、

   PMP5124测试结果如下所示、

    测试1

    CH1 PWM MOSFET (Q3) VDS

    通道2 VI

    测试条件12V/0A (轻负载)

测试2

CH1 PWM MOSFET (Q3) VDS

     通道2 VI

     测试条件12V/7A (满载时)

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    使用自驱动 SR 通过 Vin LineUV off 断电、开关节点上会出现此类电压尖峰。 一种典型方法是使软停止时间更长。 为此、IC 的 VDD 需要保持在其 UVLO 关断以上、然后增加软启动电容值。

    在次级侧添加一些额外的虚拟负载。

    使用受控驱动 SR。