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[参考译文] TPS56121:+5V 不可靠启动

Guru**** 1643550 points
Other Parts Discussed in Thread: TPS56221
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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1203056/tps56121-5v-unreliable-startup

器件型号:TPS56121
主题中讨论的其他器件:TPS56221

我们在设计中添加了电阻器和 FET 2N7002 N 沟道60V、以便实现受控启动和关闭。

当 FET 开关被启用时、+5V 电源不启动。

已检查器件值、温度和电流、似乎没有问题。

该单元在300kHz 下运行、但 在70kHz 下会有3AMPS 的大纹波电流、这可能是原因。

 

附加了电源使能(红色)、12V 电源(蓝色)、5V 输出(黄色)的 PICO 示波器捕获文件

+12V 线路上没有大压降表示存在大电流。

使能线看起来非常干净。

5V 电压开始上升但停止。 电源将尝试每50mS 重新启动一次、

是否存在可能导致此问题的其他内部故障情况?

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    请发布原理图并重新发布图像。  

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    显示 DNI FET、但实际上已加载

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    您能否将示波器图像

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    可关断器件的故障包括电流限制、过热和输入 UVLO。   

    当2N7002栅极"高电平"且 FET 处于运行状态时、它会将 EN/SS 保持为低电平、从而防止 TPS56221启动。   

    2N7002栅极"低电平"后。  EN/SS 引脚不再保持低电平、TPS56221

    通过校准序列来设置电流限制、请参阅数据表中的图19。   

    红色信号不是我希望在2N7002上看到的用于启动 TPS56221的信号、也不是开启 EN/SS 引脚。

    我认为在启动期间探测 ENSS 引脚有助于解决该问题。   如果 ENSS 引脚循环 5个虚拟软启动在上述事件之后、则是触发的 OC。  

    另一个故障可能是 UVLO、在启动序列期间探测 VDD 引脚、查看是否触发 UVLO。    

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    明天我将使用+12V、+5V、EN/SS 和 FET 门捕获示波器图像。 谢谢

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    前两部分显示了在上电后使用 FET 进行延迟来打开电源后的重试次数。 第三种是在未安装 FET 的情况下正常上电。

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    Dan、您好!

    大卫已经离开了,我跳起来去帮助你。  

    如果我正确阅读了上面的图、红色的是 IC 的 EN 信号。 每次释放 EN 引脚时、都会在该过程中产生噪声。 请参见下面的图表。 我不知道这是什么原因。 当在您的第3个图中移除 FET 时、显然不会显示。  

    现在、我想当 2N7002栅极为"低电平"时。  EN/SS 引脚仍保持不变、不允许 SS 引脚充电。 SS 引脚仅有10uA 的电流能力 为 SS 电容器充电。 如果 FET 增加额外的 阻抗、它将影响 SS。    

    谢谢!  

    Tahar

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    关断后的多个 ss 重启表明 OC 跳闸。   

    您在第一篇文章中提到了一个添加的电阻器和2N7002。   

    我看到原理图上的2N7002。  其中是添加的电阻器。   

    EN/SS 上的开漏2N7002不应改变 SS 斜升。   第三个图显示了大于2V 的 SS 波形。

    我希望波形看起来与  https://www.ti.com/lit/ug/slvu445c/slvu445c.pdf#page=16中的图9-7类似

    您是否有可以共享的 PCB 布局图像?