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[参考译文] UCC21225A:LTSpice 仿真问题

Guru**** 1821780 points
Other Parts Discussed in Thread: TINA-TI, UCC21550
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1358006/ucc21225a-issues-with-ltspice-simulation

器件型号:UCC21225A
主题中讨论的其他器件:TINA-TIUCC21550

您好!

我下载了 UCC21225A PSpice 瞬态模型 、并使用此处所述的方法将其转换为 LTSpice 模型: https://www.onethesis.com/how-to-create-an-ltspice-model-from-pspice-or-tina-ti-model/

虽然这种方法适用于其他器件、但我在此器件方面存在问题。 首先、 每当我停止仿真时、我都会收到一组错误(请参阅底部的错误)
其次、在将器件添加到现有设计中时、有时会导致仿真更改输出、即使它未连接到任何对象也是如此。

在其他仿真中(每次仿真中出现的错误似乎是随机的)、仿真将运行几个时间步长、然后仿真将冻结。

最后、在极少数情况下、它可以正常工作、因此输出看起来很奇怪。 输出(OUTA/OUTB 当连接到 FET 时)将立即以2个时间阶跃(~2ps)增加9V、然后需要~100ns 时间才能在看起来像电容器充电的曲线之后上升最后几伏。  

我确信所有这些问题都是关联的、模型有问题、很遗憾、我不知道问题是出在 PSpice 模型还是我的转换中、或者是我做的其他一些假设。

非常感谢您提供任何信息!

错误:

关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"
关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"
关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"
关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"
关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"
关于"b§e_abmgate yint 0 v={if (v (a)>{vTHRESH}&v (b)>{vTHRESH}、{VDD}、{VSS}}"中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>(vthresh)&v (b)>(vthresh)、(VDD)、(VSS)"
关于"b§e_abmgate yint 0 v={if (v (a)>{{vthresh}}、{{VSS}}、{{VDD}})}中使用花括号的问题
错误:未定义的符号位于:"if ([v](a)>((vthresh))、((VSS))、((VDD))"

绿色线是 INA 的输入、蓝色线是输出 OUTA。  经过19ns 的传播延迟后、在转换到更"正常"的充电曲线之前、输出以看似不可能的速度从-6V 跃升至刚刚超过3V。

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    尊敬的 Dakota:

    您可以尝试使用连接的型号吗? 一些模型版本在翻译成 LTSPICE 方面比其他版本困难得多。 我们通常使用 TINA-TI 和 PSPICE for TI 来设计模型。 我们不允许下载 LTSPICE 并测试我们的模型、因为它们是竞争对手、因此我们无法事先发现这些问题或自己重新创建它们。

    我设计了附加的模型、我认为我的方法与传统的 SPICE 仿真更加一致。 如果您对这款车型有任何疑问、我可以为您提供更多帮助。 它是一款非常相似的器件。

    此致、

    肖恩

    e2e.ti.com/.../UCC21550_2D00_Q1.lib

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    Sean、 非常感谢您的快速反应、非常感谢您的参与!


    它现在似乎更加一贯地工作。 输出仍然有类似的行为(一开始非常快速地跳转、然后缓慢地为剩余部分充电)、但它确实看起来更好。 您能否在仿真中确认这是什么样的结果?  
    我还在我的一个仿真中收到了奇异性矩阵问题、我似乎只能通过删除 UCC21550来修复。 我认为这在我这边是个问题、因为我使用的是隔离接地、所以最终可能会有问题。 "你想看我,我不会骗你的。"


    矩阵问题


    青色的线快速跳起来,然后缓慢地攀登这条路的其余部分

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    对于矩阵问题、也许在两个接地之间放置一个1MΩ Ω 电阻器。 您能将 IPT00文件发送给我吗? 我可以看到关于上升时间。

    UCC21550应该有一个8ns 的上升时间。 我没有在模型中真正限制上升时间、因此空载看起来可以更快地上升。 我可以尝试解决这个问题。

    此致、

    肖恩

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    什么是 IPT00文件? 我很乐意提供它,但我在网上找不到任何信息。


    我已经尝试在两个接地端之间添加一个电阻器(从1g 到1m)、但没有任何变化。 我还尝试在   UCC21550的所有引脚上添加电阻器、但都没用。  


    确切的错误是"奇异 矩阵:检查节点 U7:N006"。 问题是、 UCC21550 是 U4、而节点 N006未连接至 UCC21550 或 U7、因此我不确定到底是哪个节点导致了问题。 通过让 INA/INB 的输入悬空、我能够得到不同的错误 "奇异矩阵:检查节点 q:U7:3#collector"。 U7是 LT1413、但我在使用任何其他栅极驱动器时都没有问题(它们的性能不如 UCC21550、这就是我尝试更改它们的原因)。

    我唯一可以尝试提供的其他帮助是以下附加错误消息:

    第2535行上的错误:.model u4:_s_UVLO_VCB:_s_UVLO_VCB vswitch roff=1e6 ron =1e-3 VH=3.7 VT=5.3 td =0
    *无法识别的参数" td "——已忽略
    第2530行错误:.model u4:_s_UVLO_VCA:_s_UVLO_VCA vswitch roff=1e6 ron =1e-3 Vh=3.7 VT=5.3 td =0
    *无法识别的参数" td "——已忽略
    第2525行错误:.model u4:_s_UVLO_b:_s_UVLO_b vswitch roff=1e6 ron =1e-3 VH=1 VT=5 td =0
    *无法识别的参数" td "——已忽略
    第2520行错误:.model u4:_s_UVLO_A:_s_UVLO_A vswitch roff=1e6 ron =1e-3 VH=1 VT=5 td =0
    *无法识别的参数" td "——已忽略

    U4:_u1:vcs1:缺失值、假设为0V @ DC

    是的、如果您能够对惊人的上升时间/最大拉电流和灌电流进行建模、 你老实说一直是这么大的帮助,我感谢你投入到帮助我的所有时间。

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    IPT00文件是指我要驱动的 MOSFET 的文件? IPT004N03L
    其为内置 NMOS、源文件可在以下位置找到: https://github.com/metacollin/LTspiceInfineonNMOSLibrary/blob/master/sub/OptiMOS_30V_LTSpice.lib
    其参数为:

    。 SUBCKT IPT004N03L 漏极栅极源极 Tj 外壳参数:dVth=0 dRdson=0 dgfs=0 DC=0 Zthtype=0 Ls =1.5n LD=2n LG=3n

    。 参数 Rs=201u Rg=3 Rd=20u Rm=63u
    。 param Inn=150 Unn=10 Rmax=0.4m gmin=119
    。 参数 RRF=500m Rrbond=3m RTB=2.6 G2=999m
    。 参数 ACT=23.58 RSP=3

    。 func Pb (i、dT、Rb){rb/(2*Rtb)*(i-limit (dt/(max (i、1n)*rb)+RRF*i*g2,0、i))**2}

    x1 d1 g s sp Tj S5_30_G1_var 参数:a={act}rsp={RSP}dVth={dVth}dr={dRdson}dgfs={dgfs}Inn={INN}Unn={Unn}
    +Rmax={Rmax}gmin={gmin}Rs={Rs}Rp={Rd}DC={DC}Rm={RM}
    RG g1 g{rg}
    LG 栅极 G1{LG*IF(dgfs==99,0,1)}
    GS s1 s 值={V (s1、s)/(Rs*(1+(限制(V (Tj)、-200,999)-25)* 4m)-RM)}
    RSA s1秒1MEG
    Ls 源 s1{Ls * if (dgfs===99,0、1)}
    RDA D1 D2{Rd}
    LD DRAIN D2 {LD*IF(dgfs==99,0,1)}
    RSB 源 s1 10
    RGA 栅极 G1 10
    RDB 漏极 D2 10

    G_TH 0 TB 值={Pb (ABS (I (Ls)))、V (Tj、Tcase)、Rrbond*(1+(LIMIT ((V (TB)+V (Tj)))/2、-200,999)-25)* 4m)}
    Cthb TB 010.97米
    Rthb TB Tj{RTB}
    Rth1 Tj T1{1.12m+limit (Zthtype、0、1)* 409.35u}
    Rth2 T1 T2{15.26m+limit (Zthtype、0、1)* 5.65m}
    Rth3 T2 T3{54.01m+极限(Zthtype、0、1)* 2.34m}
    Rth4 T3 T4 {60.62m+limit(Zthtype,0,1)*65.25m}
    Rth5 T4外壳{142.24m+limit(Zthtype,0,1)*153.1m}
    CTH1 Tj 0 164.143u
    CTH2 T1 0 916.713u
    CTH3 T2 0 5.221m
    CTH4 T3 0 4.155m
    Cth5 T4 0 120.307m
    Cth6外壳0 30m

    。 结束

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    谢谢达科他、

    我将尝试使用该 FET 模型进行仿真。 您能发送整个电路的屏幕截图吗? 由于复制权限、我无法打开 LTSPICE 文件。

    此致、

    肖恩

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    尊敬的 Dakota:  

    我无法导入这些 FET 模型。 看起来它们是捆绑在一起的、并不能自给自足。  

    您可以尝试使用默认 FET 模型、甚至是电压控制开关来运行此仿真吗? 这些 FET 模型可能过于复杂、无法与我的模型配合使用、也无法收敛为有用的结果。

    此致、

    肖恩

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    栅极驱动器进行开环仿真。 我仍然无法与任何其他 IC 一起进行仿真、因为在仿真中使用它会使其他一切都运行起来很奇怪。 运行此仿真时也出错:

    第1545行错误:.model u1:_s_UVLO_VCB:_s_UVLO_VCB roff=1e6 ron =1e-3 VH=3.7 VT=5.3 td =0
    *无法识别的参数" td "——已忽略
    第1540行错误:.model u1:_s_UVLO_VCA:_s_UVLO_VCA vswitch roff=1e6 ron =1e-3 VH=3.7 VT=5.3 td =0
    *无法识别的参数" td "——已忽略
    第1535行错误:.model u1:_s_UVLO_b:_s_UVLO_b vswitch roff=1e6 ron =1e-3 VH=1 VT=5 td =0
    *无法识别的参数" td "——已忽略
    第1530行错误:.model u1:_s_UVLO_A:_s_UVLO_A vswitch ROFF=1e6 ron =1e-3 VH=1 VT=5 td =0
    *无法识别的参数" td "——已忽略

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    电容器设置为200pF

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    尊敬的 Dakota:

    这看起来很有希望。 这不是预期的结果吗? 您可以忽略 td = 0错误、如果需要、甚至可以从 SPICE 网表中删除这些项。

    此致、

    肖恩

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    它当然看起来很奇怪。 为什么它在9.5V 时保持平坦线大约6ns?  上升时间也比数据表显示的要快、但这实际上不是问题。 现在、这只是它不能用于我的其他仿真的原因。 你有什么想法吗? 我认为问题在模型中。  

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    这可能是 FET 模型包含米勒效应的方法。 当 VDS 下降时、它通过 Cds (Crss)提取栅极电流。  

    我不知道为什么它不能在与其他模型相同的 LTSPICE 电路中工作。 您目前可能必须使用更简单的 FET 模型。