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工具与软件：
大家好、
使用 DSG 关断 MOSFET 时、DSG 处于高阻抗状态或下拉至 VSS？
您好！
DSG 将通过~Ω 70mA 电流源下拉至 VSS。 但是、为了防止损坏 DSG FET、LD 引脚(连接到 PACK+)上的电压受到监控、在 DSG 引脚电压低于 PACK+时将停止放电。 这会产生一系列脉冲、这些脉冲随着时间的推移将 DSG 栅极放电至 LD 引脚的电压。
更多相关信息、请参见 8 DSG 驱动器 BQ76952、BQ76942电池监控器设计多个 FET (修订版 A)。
此致、
托马斯·赖尼
