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[参考译文] TPS61175-Q1:关于 TPS61175QPWPRQ1 SW 引脚的额定值

Guru**** 2386610 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1395542/tps61175-q1-about-the-rating-of-the-sw-pin-of-the-tps61175qpwprq1

器件型号:TPS61175-Q1

工具与软件:

尊敬的 TI 团队

 

请告诉我 TPS61175QPWPRQ1 SW 引脚的额定值。

我担心在建议的运行条件"Vo=38V"下、SW 引脚电压的绝对最大额定值为40V 时、几乎没有任何裕度

假设 SW 引脚电压的绝对最大额定值由 IC 内部红色框内的 FET 电压容差决定、并且 FET 在高于40V 的电压下可能发生故障、这是否正确?

 

此致、

Taroimo

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Taroimo:

    没错、 SW 引脚电压的绝对最大额定值由 IC 内红色框内的 FET 电压容差决定。

    值40V 是可能导致损坏的直流值。

    实际上、当使用38V 输出时、在 ns 内尖峰可能超过40V、这对于 MOS 是可以接受的。

    我们通常有余量、当使用38V 输出且布局良好时、这被视为安全的(请参阅 EVM)。

    此致、

    Fergus

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Fergus:

     

    感谢您的快速且有帮助的回答。

    为了确保合适的布局、我是否应该在以下链接中参考"3.1 Layout"?

    https://www.ti.com/jp/lit/ug/slvu260/slvu260.pdf?ts = 1722586364180&ref_url=https%253A%252F%252Fwww.ti.com%252Ftool%252Fja-jp%252FTPS61175EVM-326

     

    关于您之前的消息、您提到:

    "实际上、使用38V 输出时、在 ns 内尖峰可能超过40V、这对于 MOS 是可以接受的。"

    您能否提供有关 MOS 可以承受的瞬时尖峰电压的更多信息?

     

    此致、

    Taroimo

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Taroimo:

    为确保布局正确、我是否应该在以下链接中参考"3.1布局"?

    是的、建议遵循 EVM 上的布局、因为我们以前已经过验证、它将更加 可靠。

    您能否提供有关 MOS 能够承受的瞬时尖峰电压的更多信息?

    抱歉、没有更多信息、因为规格由设计团队提供、他们 利用典型的额定电压和尖峰计算出故障率。 这取决于 使用线性 BiCMOS 工艺选择的 MOS

    让我们确信的是、我们能够保证40V 直流额定值、并且验证了在38V 输出电压下 EVM 工作的可靠性。

    此致、

    Fergus