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[参考译文] LP3856-ADJ:设计的电路是将电能馈送到器件的输出端口

Guru**** 2562850 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1429120/lp3856-adj-designed-circuit-is-feeding-power-to-the-output-port-of-the-device

器件型号:LP3856-ADJ

工具与软件:

您好!

我们当前有一个设计意外将功率反馈到器件的 Vout 端口。 当6.4V 电源轨被断电时、在该端子上读取的电压为-0.54V。 数据表上的规格显示、在生存模式下、此端口上允许的最大电压为-0.3V。 我们在超过15个装配体上使用了此功能、但没有看到任何故障。 如果问题依然存在、TI 可否告知是否存在很高的元件故障风险? 谢谢。

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    尊敬的 Armin:

    您是否可以对输出端的泄漏电流进行估算? 如果泄漏电流大约为几毫安或更少、则可能不会有太大问题。 器件是否仍能够从负输出偏置条件启动?  

    此致、

    Nick

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    您好、Nick。  

    我们无法直接探测电流、因为它目前位于高密度 PCBA 上。 但我们这个网络中的电阻器与该路径中的电阻器串联、因此我们怀疑电流将在 mA 或 uA 范围内。 器件启动没有问题。  

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    尊敬的 Armin:

    在这种情况下、我唯一感到担忧的是、我认为通过 ESD 单元流入 OUT 引脚的电流似乎需要大于 uA 范围、因为正向偏置时 ESD 单元具有与标准二极管相似的 I-V 曲线、因此为了使电压稳定在-0.54V、我认为电流必须大于此电流。 如果您可以从设计中确信电流实际上很小(正如您提到的)、那么我认为这不是问题。 这是需要思考的问题。  

    此致、

    Nick

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    您好、Nick。  

    我们在假设 Vout 端口显示为开路的情况下对完整电路运行了一些 LTSpice 仿真。 鉴于方框图及其位于 P 沟道 MOSFET 的漏极上、此假设应该是正确的。 仿真表明、我们的电流在 uA 范围内、而电压保持在0.02V 以内。 如果这听起来不错、我很乐意考虑这一问题得到解决。

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    尊敬的 Armin:

    我同意在未上电时输出为高阻抗、因此这听起来很不错。  

    此致、

    Nick