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[参考译文] UCC21750:使用 SIC 的2L 三相逆变器(25kVA)中的 RDY 信号错误触发

Guru**** 2380860 points
Other Parts Discussed in Thread: UCC21750
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1449504/ucc21750-rdy-signal-false-trigger-in-a-2l-3-phase-inverter-25kva-using-sic

器件型号:UCC21750

工具与软件:

您好!
我在使用 SIC 器件 PN:C3M0040120K ( 2个并联)的2L 三相逆变器(25kVA)中使用 UCC21750 +UCC15241时遇到了问题。
有关 该项目的一些重要信息:
  • 输出功率= 25kVA。
  • 输出电感= 196uH。
  • 输出电压= 220-240V (相位到中性点)。
  • 开关频率:45kHZ。
  • 直流总线电压= 830V。
  • VDD COM = 15V。
  • VEE COM =-4V。
  • 电源管理类产品(VCC)-GND = 5V。
关于该问题:
当转换器在标称负载或超过80%的情况下运行时、有时会触发 RDY (UVLO)信号、但电源电压电平似乎没有问题。  
在下面的波形中、可以观察到 UVLO 线被拉低(绿色)、开关命令停止同时工作(黄色)。
用蓝色和红色显示的内容可以观察到 VDD (15V)和 VCC (5V)电压、看起来没有问题。
该问题仅在死区时间小于400ns 时发生。 死区时间为400ns 时、不会观察到该问题。
这似乎是一个噪音问题,但我想知道,是否有人已经面临一些类似的问题。
谢谢!
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Rodrigo:  

    感谢以上波形。 波形看起来噪声很大、我想知道这是由耦合到探头的系统噪声引起的、还是引脚上看到的实际波形引起的。 您能否确认使用的探测方法和探头类型?  

    如果它们是引脚上看到的实际电压、那么我可以看到明显违反规格的情况超过了绝对最大值。 例如、VCC 似乎降至~μ V 至4V、过冲至~10V。 我肯定不会说 VCC 和 VDD 波形看起来正常。  

    另外、我对波形/您的描述有两个观察结果:  

    1. 在 RDY 引脚下降大约7us 之前、VCC - GND 波形看起来比其他开关周期噪声更大。 这可能触发了系统中的 UVLO。 更干净的波形可以帮助我们更深入地理解这一点。  
    2. 您提到了死区时间大于400ns 时的问题。 观察这些波形可以看出、Vgs 上升和下降似乎需要~500ns、但很难看到、因为最小为5us/div。 可能会发生击穿、从而导致系统负荷增大并影响电源。  

    如果可以、我建议使用具有小接地环路的探头、尽可能靠近引脚捕获 VCC / VDD 波形。 这样我们可以更清楚地了解是否触发 UVLO。 此外、该问题是仅在一个电路板上发生、还是在您测试的多个电路板上发生?  

    期待您的回复、  

    Vivian