[参考译文] CCSTUDIO：将挑战从 CCS 10迁移到20...

尊敬的 Chandran：

您看到的更新错误是影响某些 Windows 环境(https://sir.ext.ti.com/jira/browse/EXT_EP-12157)的已知问题。 我们正在考虑在本周发布一份应该解决此问题的更新。

谢谢、

Ricky

此消息与此消息相关的情况如何？
无法从'vscode：/vscode：/schemas/workspaceConfig 加载模式：/schemas/workspaceConfig 未注册'vscode：/vscode"的资源提供程序。

尊敬的 Chandran：

CCS 中是否安装了任何其他扩展？

Patrick

我没有添加任何扩展、但 CCS 会自动添加28个扩展、如下所示：

有没有方法您可以直接打电话给我、我们可以在几分钟内完成此操作。 请在美国东部时间下午5点后致电。 我的电话号码：248-797-9758。

问题视图错误应该不会影响 CCS 的更新。 您是否尝试更新到 Ricky 提到的最新 v20.1.1版本？

CCS 安装在何处？ 您是否具有写入安装目录的管理员权限？

CCS v20.1.1的更新包尚不可用、但正在按计划在周末发布。 20.1.1的脱机桌面安装可在 TI.com 上的以下位置获取： https://www.ti.com/tool/download/CCSTUDIO

谢谢、

Ricky

"我做了,我仍然有问题。 你能给我打电话吗? 我的手机号码248-797-9758。

Patrick Chuong 非常感谢昨天的简短通话。 我跟踪了存储器范围重叠、发现存储器仅定义一次(例如 linker.cmd 文件中的 OCMC_RAM1 (RMX))。 但是、在某个编译工具引用它两次、这表明这是一个错误。 此外、也没有存储器溢出。 请参阅上面我的观点所附的屏幕截图。

过去是如何在 CCS Eclipse 中构建的？ 您是否能够解决到 DSP 内核的连接问题？

是否可以提供该项目供我查看？ 如果可以、您可以使用私人频道将其发送给我。

如何通过私人渠道发送工作项目?

我已经向您发送了一条私人 E2E 消息。

您好 Patrick、非常感谢您的努力。 我的经理不愿意分享它。 您能给我打电话、然后我们可以决定向您发送哪些邮件吗？ 现在、它正在 CCS 10中编译良好。

Patrick 您好、非常感谢今天上午的通话以及对 CCS 10和20进行编译。 我测量了复位引脚、这样就可以了。 但我仍然收到这个错误消息。 有什么提示？ 我看到许多用户在您的技术支持论坛上遇到了相同的问题： 设备处于重置状态。 使器件退出复位状态、然后重试此操作。 -处理器论坛-处理器- TI E2E 支持论坛

CortexA15_0：GEL 输出：-->>AM572x Cortex A15启动序列正在进行中... <<<--

CortexA15_0：GEL 输出：--> AM572x Cortex A15启动序列完成！ <<<--

C66xx_DSP2：连接到目标时出错：(错误-1180 @ 0x0)器件保持在复位状态。 使器件退出复位状态、然后重试此操作。 (仿真包9.4.0.00129)

您好、Chandran、我已将此线程重新分配给 Jacinto 团队、以帮助您解决调试问题。

尊敬的 Chandran：

我尚未使用 CCS 20、因此不确定我是否可以根据需要帮助 CCS、但内核保持复位状态、因为您必须先初始化内核、然后才能加载任何内容。

这是过去通过 GEL 文件完成的、我假设它们被用作屏幕截图所示的用途。 下一步是使用脚本启用内核。
请参阅以下取自 CCS (Eclipse)的注释

Cortex_M4_IPU1_C0: GEL Output: --->>> AM571x Cortex M4 Startup Sequence In Progress... <<<---
Cortex_M4_IPU1_C0: GEL Output: --->>> AM571x Cortex M4 Startup Sequence DONE! <<<---
Cortex_M4_IPU1_C1: GEL Output: --->>> AM571x Cortex M4 Startup Sequence In Progress... <<<---
Cortex_M4_IPU1_C1: GEL Output: --->>> AM571x Cortex M4 Startup Sequence DONE! <<<---
C66xx_DSP: GEL Output: --->>> AM571x C66x DSP Startup Sequence In Progress... <<<---
C66xx_DSP: GEL Output: --->>> AM571x C66x DSP Startup Sequence DONE! <<<---
CortexA15_0: GEL Output: --->>> AM571x Cortex A15 Startup Sequence In Progress... <<<---
CortexA15_0: GEL Output: --->>> AM571x Cortex A15 Startup Sequence DONE! <<<---

At this point you only connected to the device.. now one connects to the a15 core:

IcePick_D: GEL Output: Ipu RTOS is released from Wait-In-Reset. 
IcePick_D: GEL Output: Ipu SIMCOP is released from Wait-In-Reset. 
IcePick_D: GEL Output: IVAHD C66 is released from Wait-In-Reset. 
IcePick_D: GEL Output: IVAHD ICONT1 is released from Wait-In-Reset. 
IcePick_D: GEL Output: IVAHD ICONT2 is released from Wait-In-Reset. 
CS_DAP_DebugSS: GEL Output: --->>> CONFIGURE DEBUG DPLL settings to 1.9 GHZs  <<<---
CS_DAP_DebugSS: GEL Output: > Setup DebugSS 1.9GHz in progress...
CS_DAP_DebugSS: GEL Output: < Done with Setup DebugSS Trace export clock (TPIU) to 97MHz 
CS_DAP_DebugSS: GEL Output: < Done with Setup DebugSS PLL Clocking 1.9GHz 
CS_DAP_DebugSS: GEL Output: < Done with Setup DebugSS ATB Clocking 380MHz 
CS_DAP_DebugSS: GEL Output: < Done with Setup DebugSS Trace export clock (TPIU) to 97MHz 
CS_DAP_DebugSS: GEL Output: --->>> TURNING ON L3_INSTR and L3_3 clocks required for debug instrumention <<<<<<----
CS_DAP_DebugSS: GEL Output: ---<<< L3 instrumentation clocks are enabled >>>> ---
CS_DAP_DebugSS: GEL Output: --->>> Mapping TIMER supsend sources to default cores <<<<<<----
CS_DAP_PC: GEL Output: Cortex-A15 1 is not in WIR mode so nothing to do.
CortexA15_0: GEL Output: --->>> AM571x Target Connect Sequence Begins ... <<<---
CortexA15_0: GEL Output:     --->>> AM571x PG2.0 GP device <<<---
CortexA15_0: GEL Output: --->>> PRCM Clock Configuration for OPPNOM in progress... <<<---
CortexA15_0: GEL Output:     Cortex A15 DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     Cortex A15 DPLL is already locked, now unlocking...  
CortexA15_0: GEL Output:     Cortex A15 DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     IVA DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     IVA DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     PER DPLL OPP 0 clock config in progress...
CortexA15_0: GEL Output:     PER DPLL already locked, now unlocking  
CortexA15_0: GEL Output:     PER DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     CORE DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     CORE DPLL OPP  already locked, now unlocking....  
CortexA15_0: GEL Output:     CORE DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     ABE DPLL OPP 0 clock config in progress...
CortexA15_0: GEL Output:     ABE DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     GMAC DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     GMAC DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     GPU DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     GPU DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     DSP DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     DSP DPLL OPP 0 is DONE!
CortexA15_0: GEL Output:     PCIE_REF DPLL OPP 0 clock config is in progress...
CortexA15_0: GEL Output:     PCIE_REF DPLL OPP 0 is DONE!
CortexA15_0: GEL Output: --->>> PRCM Clock Configuration for OPP 0 is DONE! <<<---
CortexA15_0: GEL Output: --->>> PRCM Configuration for all modules in progress... <<<---
CortexA15_0: GEL Output: --->>> PRCM Configuration for all modules is DONE! <<<---
CortexA15_0: GEL Output: --->>> DDR3 Initialization is in progress ... <<<---
CortexA15_0: GEL Output:     DDR DPLL clock config for 666MHz is in progress...
CortexA15_0: GEL Output:     DDR DPLL clock config for 666MHz is in DONE!
CortexA15_0: GEL Output:        Launch full leveling
CortexA15_0: GEL Output:        Updating slave ratios in PHY_STATUSx registers
CortexA15_0: GEL Output:        as per HW leveling output
CortexA15_0: GEL Output:        HW leveling is now disabled. Using slave ratios from 
CortexA15_0: GEL Output:        PHY_STATUSx registers
CortexA15_0: GEL Output: --->>> DDR3 Initialization is DONE! <<<---
CortexA15_0: GEL Output: --->>> Mapping TIMER supsend sources to default cores <<<<<<----
CortexA15_0: GEL Output: --->>> IPU1SS Initialization is in progress ... <<<---
CortexA15_0: GEL Output: --->>> IPU1SS Initialization is DONE! <<<---
CortexA15_0: GEL Output: --->>> IPU2SS Initialization is in progress ... <<<---
CortexA15_0: GEL Output: --->>> IPU2SS Initialization is DONE! <<<---
CortexA15_0: GEL Output: --->>> DSP1SS Initialization is in progress ... <<<---
CortexA15_0: GEL Output: DEBUG: Clock is active ... 
CortexA15_0: GEL Output: DEBUG: Checking for data integrity in DSPSS L2RAM ... 
CortexA15_0: GEL Output: DEBUG: Data integrity check in GEM L2RAM is sucessful! 
CortexA15_0: GEL Output: --->>> DSP1SS Initialization is DONE! <<<---
CortexA15_0: GEL Output: --->>> IVAHD Initialization is in progress ... <<<---
CortexA15_0: GEL Output: DEBUG: Clock is active ... 
CortexA15_0: GEL Output: --->>> IVAHD Initialization is DONE! ... <<<---
CortexA15_0: GEL Output: --->>> PRUSS 1 and 2 Initialization is in progress ... <<<---
CortexA15_0: GEL Output: --->>> PRUSS 1 and 2 Initialization is in complete ... <<<---
CortexA15_0: GEL Output: --->>> AM571x Target Connect Sequence DONE !!!!!  <<<---

Then find the menu above that has Scripts-->AM57x_MULTICORE Initialization-->DSPSSClkEnable_API
Should look like this:

 GEL Output: --->>> DSP1SS Initialization is in progress ... <<<---
CortexA15_0: GEL Output: DEBUG: Clock is active ... 
CortexA15_0: GEL Output: DEBUG: Checking for data integrity in DSPSS L2RAM ... 
CortexA15_0: GEL Output: DEBUG: Data integrity check in GEM L2RAM is sucessful! 
CortexA15_0: GEL Output: --->>> DSP1SS Initialization is DONE! <<<---

嗨、Josue、我们的一位工程师也暗示了 GEL 文件。 我的问题是、为什么现在？ 这上周有效...也许一些 GEL 文件(无论它们是什么、做什么)在清理和迁移期间被删除了？ 在任何情况下,你能给我发送文件和他们需要去的位置.

Chandran、
解释是否可以正常工作的设置？ 有何差异？  

相同的设置不再起作用。 它确实适用于另一位工程师(他的设置我=using ),但他不会回来,直到星期二(4月8日)。 您能给我打电话、以便我们能够快速解决这个问题吗？

我的号码：248-797-9758。 我正在签核、但您可以给我打电话。

Chandran、

这毫无意义...  

Unknown 说：

我的问题是、为什么现在？ 这上周有效...也许一些 GEL 文件(无论它们是什么、做什么)在清理和迁移期间被删除了？ I [/报价]

在您的设置中、某个器件会使内核解除复位状态、但这并不只是发生。 请注意工作场景中遵循的确切程序。

CCS 20.x 尚未正式用于测试 AM57、因此我没有相关经验、因此在这方面我没有太多帮助。 请阅读 CCS 版本随附的文档。

-Josue

这不是硬件问题、并且器件未处于复位状态。 因为、测试连接对所有内核都是干净的。 请在下面查看良好的结果：

Chandran、

这仅证明 SoC 正常工作、器件中的连接/互连都正常工作。  部署的软件用于设置/释放内核以防止复位。 如果您使用 GEL 文件/或无引导模式、则必须使用相同的 GEL 文件从复位中释放内核。  

另一个注意事项是、这是否需要迁移到 CCS 20？ 这些版本中弃用了对 TI-RTOS 的支持。

您是否正在使用其他操作系统？

-Josue

请注意、CCS 版本10.x 中也存在此问题。 是的、我们使用 TI RTOS。 我认为这是 TI 工具链中的一个故障/漏洞、会给我们造成很多伤害和生产力损失。 我们现在在两个不同的物理位置有3块电路板、所有电路板都存在相同的问题。 它们都正常工作、但无法进行调试。 请与专家交谈、并致电248-797-9758与我联系。

Chandran、

请分享您的确切程序

请参阅以下文档： software-dl.ti.com/.../AM572x_GP_EVM_、Hardware_Setup

-Josue

您好、Josue、我们不会回到版本6。 请在上面查看我的通信日志、并致电我处理此问题。

Chandran、

您的日志显示您的设备处于重置状态。

Unknown 说：

C66xx_DSP2：连接到目标时出错：(错误-1180 @ 0x0)器件保持复位状态。 使器件退出复位状态、然后重试此操作。 (仿真包9.4.0.00129)

我在上面分享的文档说明了如何在随附的视频中执行以下操作：

e2e.ti.com/.../CCS_5F00_c66x_5F00_core_5F00_out_5F00_of_5F00_reset.mp4

此致、

Josue

您的同事 Patrick 已尝试过相同的流程、但问题未解决。 还包括 Reset 是一条虚假的错误消息-电路板中没有物理复位、我之前说过这一点。  我们需要确保正确执行 GEL 文件。 如果你有信心解决这个问题,你需要拿起电话,现在打电话给我,停止这不必要的无用追逐鬼. 我别无选择、只能通过我们的首席执行官升级到您的高级首席执行官、因为我们期望作为一个普通客户、能够获得更好、更快速的解决方案。 由于技术支持不佳、我们还决定将哪种微型设备用于我们未来的产品。

Chandran、  

我会将您的情况告知我的管理层。 请通过私人消息向我发送您的电子邮件、我可以安排适当的业务电话。

您是否联系过当地的 FAE？

-Josue

chandran.palanisamy@emerson.com

已发送会议邀请。

很抱歉、我还没有收到任何会议邀请。 我刚刚刷新了收件箱。 下面是我设置的、我们也可以使用。
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此致、

Chandran Palanisamy  |高级电气工程师(基于模型的开发)|布兰森焊接和组装

艾默生自动化解决方案 | 46280 Dylan Dr #100 | Novi, MI 48377, USA.

+1 (248) 797-9758.

Chandran.Palanisamy@Emerson.com

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