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[参考译文] TDA4VE-Q1:TDA LPDDR4_READ 眼罩规格

Guru**** 2369410 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1506605/tda4ve-q1-tda-lpddr4_read-eye-mask-specification

器件型号:TDA4VE-Q1

工具/软件:

我这里使用 Hyperlynx 进行 LPDDR4 (3733Mbps) SI 仿真、

  1. 在读取周期中、我们在设置和保持时间方面失败、裕度较小。
  2. 目前、我们使用的 Rx 眼图宽度=0.66UI (177ps)-根据应用手册"lpddr4_Board_design_and_layout_guidelines _spracn9e"
  3. 0.66 UI 似乎非常严格、因此即使我们的眼图张开度很大、测量工具也会显示出微小故障。
  4. 此数据速率是否有任何更新的规格、如果有、请发送给我们。

应用手册截图

e2e.ti.com/.../LPDDR4_5F00_Board_5F00_design_5F00_and_5F00_layout_5F00_guidelines_5F00_spracn9e.pdf

应用手册文件

-这是从 DDR 批处理报告 hyperlynx 读取周期的结果。

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    尊敬的 Antoine Chapuis1 、

    您能否尽快查看上述查询并提供您的回复。

    谢谢。此致、

    Sathish  

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    您好、

    Unknown 说:
    是否有此数据速率的任何更新规范、如果有、请发送给我们。

    否、LPDDR4-3733所需的菱形读取眼图模板从0.66 UI/120mV 没有变化。

    最新版本的文档可在产品页面的技术文档下找到。 链接如下: https://www.ti.com/lit/pdf/spracn9 

    在读取周期中、我们无法以较小的余量实现设置和保持时间。

    Hyperlynx 如何确定设置/保持要求、以及设置为什么?

    您是否能够直观地看到数据眼并覆盖所需的眼罩?

    此致、
    Kevin

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    尊敬的 Kevin:

    Hyperlynx 从定义的计时模型中计算所需的设置/保持时间。

    下面是 Hyperlynx 考虑设置要求的计算方法。

    是的、我们可以看到眼图(如下所示)、它有相当大的开口、但要考虑 根据 DRAM 时序模型的输出变化(-42.8ps)参数 我们无法满足设置/保持要求。

    实际建立时间 =测得的建立时间+输出变化= 128ps - 42.8ps = 85.2ps  

    MARGIN = 85.2ps - 88.4ps =-3.2ps。

    谢谢。此致、

    Sathish

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    您好、

    感谢您提供这些详细信息。 我的理解是、我们 文档中的读取眼图模板已经包括 DRAM 输出变化。 换句话说、与读取眼图模板相比、无需进一步减小仿真眼图的测量宽度。

    此致、
    Kevin

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    尊敬的 Kevin:

    感谢您的答复。

    然后、我可以考虑 DRAM 时序模型导致的输出变化 50% UI (134.2ps) 而不是在仿真中将66%的 UI (177ps)用作读取眼图模板。

    例如、66% UI = 177ps - 42.8ps = 134.ps (50% UI)

    我的理解是否正确??

    谢谢。此致、

    Sathish