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[参考译文] DRA821U:如果是 DRA821 CPSW2G 和 CPSW5G、则支持 MAC 侧 RGMII 模式下的 TX_CLK 延迟和 RX_CLK 延迟

Guru**** 2457760 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1551064/dra821u-if-dra821-cpsw2g-and-cpsw5g-suport-tx_clk-delay-and-rx_clk-delay-in-mac-side-rgmii-mode

器件型号:DRA821U
主题:DRA821 中讨论的其他器件

工具/软件:

Champ、  

我们能否确认 DRA821 MAC 侧是否可以执行 RGMII TX CLK 延迟和 RX CLK 延迟?

在 TRM 中、两者显示不支持禁用 RGMII 内部延迟模式。  

客户发现 CPSW2G 和 CPSW5G 上的延迟时间(输出时序)不同。  

他们想知道是否可以通过 MAC 侧的寄存器设置时钟延迟?  

CPSW2G:

CPSW5G:

下面是 TI DP83867 千兆位以太网 PHY、它支持 TX 和 RX 时钟的 16 级延迟设置、客户选择的 PHY 只能设置 1 级 (2ns)。   

Br、Rich

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    您好、

    我们能否确认 DRA821 MAC 侧是否可以执行 RGMII TX CLK 延迟

    可从以下寄存器中选择 DRA821 MAC 侧支持 RGMII TX 延迟。 默认情况 下启用 Tx 延迟。

    MAC 仅支持 Rx 侧的延迟。

     Rx 延迟 必须由 PHY 或原理图布线控制。

    下面是 TI DP83867 千兆位以太网 PHY、它支持 TX 和 RX 时钟的 16 级延迟设置、客户选择的 PHY 只能设置 1 级 (2ns)。   [/报价]

    PHY 同时提供 Tx 和 Rx 延迟、其中不支持 MAC、可以从 PHY 配置。

    此致、
    Sudheer

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    Sudheer,  

    感谢您的确认、我找到了其余的四个 ENETx_CTRL 寄存器、默认值为 0x0、CPSW5G 端口中的 TX 延迟也已启用。  

    也没有 RX 延迟功能。  

    感谢您的确认。   

    Br、Rich

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    您好、

    [报价 userid=“9853" url="“ url="~“~/support/processors-group/processors/f/processors-forum/1551064/dra821u-if-dra821-cpsw2g-and-cpsw5g-suport-tx_clk-delay-and-rx_clk-delay-in-mac-side-rgmii-mode/5970771

    感谢您的确认、我找到了其余的四个 ENETx_CTRL 寄存器、默认值为 0x0、CPSW5G 端口中的 TX 延迟也已启用。  

    也没有 RX 延迟功能。  

    感谢您的确认。   

    [/报价]

    是、如上所述、MAC 仅支持 Tx 延迟、而不支持 Rx。

    此致、
    Sudheer