https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1562629/tda4vm-tda4
器件型号:TDA4VM工具/软件:
我们无法在 TDA4 仿真器上运行 C7x 优化代码。 有关如何在 TDA4 上执行的信息、请提出建议
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器件型号:TDA4VM工具/软件:
我们无法在 TDA4 仿真器上运行 C7x 优化代码。 有关如何在 TDA4 上执行的信息、请提出建议
尊敬的 TI 团队:
我们已经使用 c7x 工具链 ( ti-cgt-c7000_4.1.0.LTS) 开发了一种图像处理算法、并使用 cl7x 编译器进行了编译。
使用 Ubuntu 系统(版本 22)中的 Code Composer Studio 工具(版本 12.4)执行此操作。 此后、我们遵循了为 j721e SoC 设置的 CCS、并通过 UART 连接使用板载调试器连接到 SoC 中的内核。 当我们尝试在 c7x 内核上加载.out 时、我们遇到了内存映射问题。 您能帮我们在 C7x 内核上加载.out 吗?
尝试加载.out 后 Cosole 中显示错误:
C71X_0:文件加载程序:验证失败:地址 0x000000008030 中的值不匹配请验证目标存储器和存储器映射。
C71X_0:GEL:文件:/home/srinivasthalam/workspace_v_latest/rgbir_instrinsic/Debug/rgbir_instrinsic.out:发生数据验证错误、文件加载失败。
您好、
您能否请确认是否按照以下步骤设置 CCS? https://software-dl.ti.com/jacinto7/esd/processor-sdk-rtos-jacinto7/latest/exports/docs/psdk_rtos/docs/user_guide/ccs_setup_j721e.html
我还会与您分享有关如何执行目标配置和在 CCS 中测试连接的常见问题解答: 【常见问题解答】TDA4VL-Q1:如何在 J721S2 EVM 上创建“Target configuration“和执行“Test connection“
您也可以参阅以下文档: software-dl.ti.com/.../troubleshooting-data_verification_errors.html
使用板载调试器 XDS110 连接到 SoC 中的内核此后、我们遵循了为 j721e SoC 设置的 CCS、并通过 UART 连接
您能否确认是否尝试在裸机模式下无引导模式运行.out 文件? 如果是、请尝试通过 XDS110 JTAG 接口进行连接。
您能分享您使用的.out 文件以便我在我的最后进行测试吗? 此外、请验证所用 GEL 文件的路径。
此致、
Shabary S Sundar
尊敬的 Shabary:
1.是的,我们已经遵循了你提到的确切设置。
https://software-dl.ti.com/jacinto7/esd/processor-sdk-rtos-jacinto7/latest/exports/docs/psdk_rtos/docs/user_guide/ccs_setup_j721e.html
2..ccxml 文件也是按照您提到的方式创建的。
e2e.ti.com/.../faq-tda4vl-q1-how-to-create-target-configuration-and-do-test-connection-on-j721s2-evm
3.还设置了无引导
SW8[1-8]= 1000 1000 且 SW9[1-8]= 0111 0000
是的,我们只连接了 J3 USB 连接器 (Ubuntu PC -> J3 )。
4.由于我们已经按照 TI 文档中提到的所有内容进行了操作,并面临了这个问题,
我创建了一个参考文档、以便您更好地理解问题并将其附在此处。
请浏览此文档、告知我们是否需要.out、同时我们将浏览您分享的错误参考链接。
5.我们将简短地向您分享一个示例.out。
此致、
Srinivas Thalam
好的、我正在共享我的个人驱动器中的链接、请尝试此操作。
也可以在邮件中找到你。
https://drive.google.com/file/d/1yvH4mt5b5SAzhJeEEZqQsJCQ2DgPR2qw/view?usp=drivesdk
您好、
您可以将这些文档发送给我。(x1246483@ti.com)
此致、
Shabary S Sundar
您好、
下面我附上了(通过邮件共享)示例.out 供您参考。 可执行文件在 J721E 上进行了最终验证、可正常运行。 请检查并确认您的身份是否相同?
[MCU_Cortex_R5_0] SCICLIENT_CCS_INIT: Apr 10 2025, 15:32:46Sciclient_Init Passed.
=================================================================
DEVGRP = 1
=================================================================
SYSFW Common Board Configuration with Debug enabled... PASSED
SYSFW PM Board Configuration... PASSED
SYSFW Security Board Configuration... PASSED
=================================================================
Sciclient Dev Group 01 initilization started
Power on the WKUPMCU to MAIN and MAIN to WKUPMCU VDs... PASSED
=================================================================
DEVGRP = 2
=================================================================
SYSFW Common Board Configuration with Debug enabled... PASSED
SYSFW PM Board Configuration... PASSED
SYSFW Security Board Configuration... PASSED
=================================================================
DMSC Firmware Version 11.0.9--v11.00.09+ (Fancy Rat)
Firmware revision 0xb
ABI revision 4.0
=================================================================
Sciclient_ccs_init Passed.
SCISERVER Board Configuration header population... PASSED
[C71X_0] DSPLIB debug DSPLIB_TEST_init - 67: rand seed = 1757418813
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 1
---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
DSPLIB_max testing starts.
---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
| No | ID | Status | Num pt | Kernel Init | Kernel Compute | NatC Compute | Arch. Compute | Efficiency | Est. Compute | Accuracy | Description
| | | | | cyc | cyc | cyc | cyc (est.) | vs Arch.(%) | cyc (est.) | vs Est.(%) |
---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
DSPLIB_DEBUGPRINT DSPLIB_max_d data_type 12 dataSize 512
DSPLIB_DEBUGPRINT DSPLIB_max_d pIn1 64800380
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 1 status_init 0
Enter DSPLIB_max_init_checkParams
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 512 bufParamsIn->data_type 12
DSPLIB_DEBUGPRINT bufParamsIn->data_type == DSPLIB_FLOAT32
Enter eleCount 16
DSPLIB_DEBUGPRINT CP 3 status 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 2 status_init 0
Enter DSPLIB_max_exec_checkParams
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 3 status_opt 0
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_ci
Enter eleCount 16
DSPLIB_DEBUGPRINT blockSize 512
Enter DSPLIB_max_init_checkParams
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 4 status_opt 0
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 512 bufParamsIn->data_type 12
DSPLIB_DEBUGPRINT CP 3 status 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 5
DSPLIB_DEBUGPRINT Enter DSPLIB_max_exec
DSPLIB_DEBUGPRINT pKerPrivArgs->blockSize 512
Enter DSPLIB_max_exec_cn
Enter pInLocal 64800380 pOut 80200000
counter 0 a 0 b -2147483648
counter 0 y 0
counter 1 a 0 b 0
counter 1 y 0
counter 2 a 0 b -2147483648
counter 2 y 0
counter 3 a 0 b 0
counter 3 y 0
counter 4 a 0 b -1073741824
counter 4 y 0
counter 5 a 0 b -2147483648
counter 5 y 0
counter 6 a 0 b 0
counter 6 y 0
counter 7 a 0 b 0
counter 7 y 0
counter 8 a 0 b 0
counter 8 y 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 6 status_nat 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 7 comparisonDone 1 status_nat_vs_opt 1
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 8 status_nat_vs_opt 1 status_ref_vs_opt 1 currentTestFail 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 8 status_init 0 status_opt 0 status_nat 0
DSPLIB_DEBUGPRINT DSPLIB_max_d CP 8 fail 0
| 1 | 2 | PASS | 512 | 2962225229 | 2284796623 | 7051787175 | 0 | 0 | 0 | 0 | RANDOM generated input | Data size = 512 Data Type 12
Test Pass!
Test 0: Cold Cycles = -2010170673, Warm Cycles = 1687469968, Warm Cycles WRB = 1085531726
Enter DSPLIB_max_init_checkParams
Enter DSPLIB_max_init_checkParams
| 2 |1000 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Enter DSPLIB_max_init_checkParams
Enter DSPLIB_max_init_checkParams
| 3 |1001 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Enter DSPLIB_max_init_checkParams
Enter DSPLIB_max_init_checkParams
| 4 |1002 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Enter DSPLIB_max_exec_checkParams
| 5 |1003 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Enter DSPLIB_max_exec_checkParams
| 6 |1004 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize -1402269312 bufParamsIn->data_type 3
DSPLIB_DEBUGPRINT CP 2 status 3
DSPLIB_DEBUGPRINT CP 3 status 3
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize -1402269312 bufParamsIn->data_type 3
DSPLIB_DEBUGPRINT CP 3 status 3
| 7 |1005 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Enter DSPLIB_max_init_checkParams
Enter DSPLIB_max_init_checkParams
| 8 |1006 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 8 bufParamsIn->data_type 13
DSPLIB_DEBUGPRINT CP 3 status 0
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 8 bufParamsIn->data_type 13
Enter eleCount 8
DSPLIB_DEBUGPRINT CP 3 status 0
| 9 |1007 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 4 bufParamsIn->data_type 13
DSPLIB_DEBUGPRINT CP 3 status 0
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 4 bufParamsIn->data_type 13
Enter eleCount 8
DSPLIB_DEBUGPRINT CP 3 status 0
| 10 |1008 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 14 bufParamsIn->data_type 13
DSPLIB_DEBUGPRINT CP 3 status 0
DSPLIB_DEBUGPRINT Enter DSPLIB_max_init
DSPLIB_DEBUGPRINT DSPLIB_max_init pKerPrivArgs->blockSize 14 bufParamsIn->data_type 13
Enter eleCount 8
DSPLIB_DEBUGPRINT CP 3 status 0
| 11 |1009 | PASS | 0 | 0 | 0 | 0 | 0 | nan | 0 | nan | COVERAGE TEST
Test Pass!
此致、
Shabary S Sundar
尊敬的 Shabary:
我已尝试运行您共享的.out、出现以下错误。
在 c7x 内核上加载.out 时是否需要源代码。
/home/thalamr/workspace_v_latest/rgbir_instrinsic/Debug/test_DSPLIB_max_C7100.out 上没有“main() 的可用源:{3} 0x70411980 {4}“
此致、
Srinivas Thalam
您好、Srinivas、
您能否确认我们所遵循的步骤是否正确?
是的、您的步骤正确。
请确保以下各项:
1.使用位于以下位置的 lnk.cmd 文件:“TI-PROCESSOR-SDK-RTOS-j721e-evm-11_00_00_06\DSPLIB\cmake\linkers\C7100\lnk.cmd"</s>“
2.确认您正在为 C7100 构建。
此致、
Betsy Varughese.