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[参考译文] AM3505:加电定序

Guru**** 2611705 points
Other Parts Discussed in Thread: AM3505

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/575604/am3505-power-up-sequencing

器件型号:AM3505

您好!

我们需要对 AM3505上电定序进行澄清。
我们的客户正在使用分立式电源 IC 设计其电源电路
我们需要您对 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 电源的定序顺序有意见。

根据当前数据表 VDDS、VDDS_SRAM_CORE_BG/VDDS_SRAM_MPU/VDDSOSC
所有电压均按如下所示斜升。



但在我们客户的电路中、VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 会斜升
或 VDDSHV (3.3V)之前的电压、如下所示。



查看之前的数据表、可以看到 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 上升
VDDSHV (3.3V)之后。
因此、我们认为 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 可以在 VDDSHV 之前或之后斜升
或者与 VDDSHV 一起为 VDDS (1.8V)供电。



请告知我们是否允许使用此类设备。

此致
库米

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    您好!

    最新数据表中的信息会覆盖所有旧数据表修订版本。 AM35x 数据表修订版 F 中的第5.8.1节规定:

    1. IO 1.8V 电源(VDDS)、带隙和 LDO 电源(VDDS_SRAM_CORE_BG、VDDS_SRAM_MPU)和振荡器电源(VDDSOSC)应首先进入稳定状态。
    2. IO 3.3V (VDDSHV)电源应在稳定状态旁斜升。
    3. 内核(VDD_CORE)电源紧随稳定状态。
    4. 所有 PLL 电源(VDDS_DPLL_PER_CORE、VDDS_DPLL_MPU_USBHOST)和1.8V 复杂 IO 电源(VDDA_DAC、VDDA1P8V_USBPHY)应在稳定状态旁斜升。
    5. 最后、3.3V 复数 IO (VDDA_3P3V_USBPHY)应斜升。
    6. 在电源斜升时、SYS_nrespwron 必须保持低电平、直到 SYS_32k 和 SYS_xtalin 时钟稳定。

    必须遵循数据表要求以确保器件正常运行。 否则可能会导致器件可靠性问题或对器件造成永久损坏。

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    您好、Biser、

    非常感谢您提供的信息。

    实际上、该应用与我们在下面讨论的应用相同
    E2E 去年。 很抱歉、我再次提出了相同的主题。
    e2e.ti.com/.../1910912

    我们从上述 E2E 中得到了建议、说...

    "如果 VDDS 首次上电、则在随后为 VDDS_SRAM_xxx、VDDSOSC 供电时没有问题。
    如应用手册中所述、如果有常见的1.8V 电压为所有这些电源轨供电、您也可以将它们组合在一起"。

    因此、根据这条评论、我们认为一旦 VDDS 加电、VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 会升高
    之后(VDDSHV 之后或 VDDSHV 之前)正常。
    但我们不确定当 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 和 VDDSHV 都正常时、情况是否正常
    斜坡。

    我们知道、这个问题不在数据表内容中、但是您的建议
    将有助于纠正客户应用中的必要电路。

    此致
    库米
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    很抱歉,我忘记了这一点。 Sivak 来自工厂团队、因此他对另一个主题的评论是正确的。 很抱歉造成混淆。
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    您好、Biser、

    感谢您的确认。

    但是、如上所述、如果 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG 都正常、我们需要进行一次确认
    和 VDDSHV (3.3V)同时斜升。

    在我们客户的设计中、VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG (1.8V)
    VDDSHV (3.3V)电源似乎几乎同时上升、如下所示。
    如果允许、我们可以继续进行当前设计。


    此致
    库米

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    我已要求工厂团队进行评论。 他们将在这里作出回应。
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    您能否提供详细的加电/断电 图以及所涉及的时序? 不清楚这是实际示波器测量还是可能的上电情况。 此外、请确保遵循前面讨论的断电顺序。

    此致、Siva

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    您好、Siva、

    非常感谢您考虑此请求。
    下面是时序的加电图。

    实际上、VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG (1.8V)设计为在 VDDSHV (3.3V)之后斜升、
    但是、由于1.8V 电源电路的变化、 VDDS_SRAM_xx 电源斜升至接近(1ms - 6ms)的 VDDSHV、
    几乎同时斜升。

    下面是示波器的实际加电时序截图。

    (绿色 CH4为1.8V (DPLL))


    关于断电顺序、我们去年收到了您的建议
    在不同的 E2E 帖子上、两者之间的差异为1.8V(VDDS)和 VDDSHV(3.3V)
    保持在<2V、如下所示。

    请告知我们是否允许在加电期间同时进行 VDDS_SRAM_xx 和 VDDSHV (3.3V)斜坡。

    此致
    库米

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    如果对此有任何建议、请告知我。
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    他正在旅行、可能需要几天时间才能在这里回复...抱歉。

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    您好、Siva、

    很抱歉打扰你、
    如果对此有任何建议、请告知我。
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    对此进行了任何更新?
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    Kummi、很抱歉耽误了时间...我正在升级这个...

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    您好、Rogerio、

    谢谢...有任何更新? 如果您能尽早提供结论、将会非常有帮助。

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    正确。 您可以拆分1.8V VDDS_SRAM_CORE_BG 和 VDDS_SRAM_MPU 1.8V 电源轨、使其在 VDDSHV (3.3V)之后斜升。

    此致、Siva

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    您好、Siva、

    非常感谢您的回复。

    很抱歉、我们的上电顺序是否正确?

    这意味着 VDDS_SRAM_MPU/VDDS_SRAM_CORE_BG (1.8V)和 VDDSHV (3.3V)
    同时(低于)斜升是否正常?  如果是、我们将继续进行当前设计。



    此致
    库米

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    库米

     如示波器图所示、VDDS_SRAM_CORE_BG [1.8V]和 VDDS_SRAM_MPU [1.8V]与 VDDSHV [3.3V]一起斜升的电源序列对我来说很好。 我假设您在根据数据表中的要求应用复位后首先斜升 VDDS 和 VDDS_OSC 斜升。

    从示波器图中可以看出 VDDSHV 电源斜坡不是线性的。 您是否发现导致此行为的原因? 它看起来绿色波形(不确定这是什么电源)也不是线性的。

    此致、Siva

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    您好、Siva、

    非常感谢您的帮助。
    我们将继续进行当前的设计。

    是的、我们在之后首先斜升 VDDS 和 VDDS_OSC
    根据数据表中的要求应用复位。

    VDDSHV 电源的非线性行为是由引起的
    电源的软启动特性、用于
    与 AM3505的加电序列匹配。

    此致
    库米