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[参考译文] TMS320C6748:upp &FPGA

Guru**** 2541920 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/601137/tms320c6748-upp-fpga

器件型号:TMS320C6748
Thread 中讨论的其他器件:OMAPL138

尊敬的论坛

网络上的电弧某些原理图显示 C6748 (或类似)连接到某些 FPGA,但我没有找到。 可能是因为它非常简单。

数据从 FPGA 传输到16位宽的 DSP

因此、问题是:

我们需要的连接器仅为 uPP_D[0]- uPP_D[15]   + EN-START-CLK-WAIT?

-不需要 uPP_2xTXCLK。对 吗?

如果 CPU 时钟为375MHZ,uPP_CLK 可能最大为375/4 =93 MHz,因此我们可以达到最大93兆字/秒。  (1字=16位) 是否正确?

收到任何其他建议。

感谢你能抽出时间

Roberto

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    尊敬的 Roberto:

    我们将对此进行研究。 反馈将发布在此处。

    此致、
    Yordan
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    您好 Roberto
    我们的 uPP 的故事有点精简,因为我们没有任何显示 uPP 与 uPP/DAC 或 FPGA 连接的驱动程序和评估模块。

    请查看以下 wiki 是否对连接建议和数据速率有所帮助。

    processors.wiki.ti.com/.../Introduction_to_uPP

    要获得更完整的硬件/软件解决方案、我建议使用 Critical Link
    www.criticallink.com/.../
    它们具有显示 OMAPL138的 UPP 到 FPGA 接口的电路板和软件,OMAPL138是与 C6748同一系列中的 ARM+DSP 型号。

    在 Tx CLK 上、请参阅后续帖子是否有用

    e2e.ti.com/.../107588

    此致
    Mukul
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    非常感谢您的帮助。

    Roberto