[参考译文] AM3352：GPMC 总线上的4个器件出现猝发写入问题

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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/625092/am3352-burst-write-issues-with-4-devices-on-gpmc-bus

器件型号：AM3352

你(们)好。

关于 GPMC 总线-在下面查找说明。总线上有4个器件、但总电容小于30pF。谢谢！

“高达100MHz 的外部存储器时钟性能(单个设备)”

当 GPMC 上的总容性负载低于30pF 时、我应该如何阅读上述内容：

a) GPMC 仅在 GPMC 连接到单个器件…..周期时才可支持100MHz 时钟；因此、当两个或多个器件连接到不同#CSx (x = 0、1、2、3)上的 GPMC 时、最大时钟必须低于100MHz (分别为50MHz…) 任何一个#CS。

b) GPMC 可以在单芯片选择(#CS)上支持100MHz 时钟、所有连接到其他#CS 的其他器件必须设置为低于100MHz (分别为50MHz…μ s)

8 年多前

0 admin 8 年多前

TI__Guru**** 2587345 points

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我已通知工厂团队。他们的反馈将在此处发布。

此致、
Yordan

0 admin 8 年多前

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请提供此问题的更新。

0 admin 8 年多前

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您好、Catalin、 Jarred、

您是否注意到了这一点

"尽管 GPMC 接口最多可驱动7个片选、但为该接口指定的频率用于特定负载。如果超过此负载、则无法达到最大频率。一种解决方案是实现具有缓冲器的电路板、以使最慢的器件保持线路上的总负载"

上述信息表明、如果未达到指定的最大负载(有关此信息、请参阅数据表)、则应能够达到100MHz。让我确认这一点。

此致、
Yordan

0 admin 8 年多前

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Yordan、您好！

是的、我知道 AM335x TRM 中的这个短语。但是、我们希望看到对该声明的"官方"TI 更正：
“高达100MHz 的外部存储器时钟性能(单个设备)”。

我们认为 GPMC 上的最大容性负载规格应该已经足够了；无需"(单个器件)"提及.... 除非有没有明确说明的东西… 这种可能的"东西"是我们有点困惑的原因...并要求澄清...

此致、
Catalin

0 admin 8 年多前

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Catalin、

我与设计团队进行了交谈。
该接口在最大负载下以100MHz 的时间进行计时闭合、但计时闭合不理解在将四个器件连接到总线时产生的任何信号完整性问题。在设计 PCB 时、需要考虑残桩和阻抗不匹配在连接多个器件时对信号的影响。客户应模拟其 PCB 布局并进行适当的调整、以解决影响时序的信号完整性问题。

此致、
Yordan

处理器（参考译文帖）

处理器（参考译文帖）(Read Only)

[参考译文] AM3352：GPMC 总线上的4个器件出现猝发写入问题