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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1362396/tda4vh-q1-sdk8-6-cpsw9g-rx-error
您好，TI，专家
首先、我们发现 RX 数据包为0；
e2e.ti.com/.../MCU20_5F00_log.txt
您好！ 您能不能捕获 CPSW 统计数据并与我们分享一下？ 有关收集 CPSW 统计信息、请参阅常见问题解答。 您许多需要将 FAQ 中的补丁集成到 EthFw 中并观察 MCU2_0的统计信息。 确保捕获正确的端口统计信息。 此外、您能否确认您是否正在使用 QNX 客户端运行？ 我可能会通过上面共享的日志看到端口1、端口2以10Gbps 的速率建立链路？ 此致、 苏德黑尔
您好，专家：
使用 Linux 客户端
4.043889 s：Cpsw_openPortLinkNoPhy：端口1：链路建立：10Gbps 全双工 internone_log.cpp：LogDeviceSendString：110 tid：281473114665184 10.970569 s：Cpsw_openPortLinkNoPhy：端口2：链路建立：10Gbps 全双工 internone_log.cpp：LogDeviceSendString：110 tid：281473114665184
有链路建立时间时、PORT2与 VH 的链路，链路建立时间长于10s
您好！ 您能分享 EthFW 的完整日志吗？ 另外、我可以从 EthFw 看到、端口打开后会等待链路建立。 反映端口链路接通状态的原因可能是链路接通延迟、也可能是链路伙伴链路接通延迟。 此致、 苏德黑尔
您好，TI 专家：
可以通过链路建立调优 和某个接口来恢复或重新生成端口？
您好！
可以通过链路上调谐 和一些接口来恢复或重新创建端口？
否、应建立链路。 依据 S/W 设计。 根据我的理解、如果链路未建立、在从主机端口向此端口发送数据包时、主机 FIFO 将被阻止、不再从主机端口进行传输。 由于非链路端口导致主机端口 FIFO 填满。 此致、 苏德黑尔
