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[参考译文] DRA829J-Q1:OSPI 接口

Guru**** 2487425 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1440194/dra829j-q1-ospi-interface

器件型号:DRA829J-Q1
主题中讨论的其他器件:DRA829

工具与软件:

大家好:在主板上电之前、请帮助确认 DRA829的 F19引脚的默认状态、谢谢。 在测量波形时、我们发现主板上电时、对应于 F19引脚的 MCU_OSPI0_CS#信号被拉低、但该信号在原理图中具有10K 上拉电阻器。 在正常情况下、在加电完成前无法选择 OSPI 芯片。 是否可以通过软件配置将其更改为默认上拉?

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    您好!

    已翻译申请:
    大家好:在主板上电之前、请帮助确认 DRA829的 F19引脚的默认状态、谢谢。 在测量波形时、我们发现主板上电时、对应于 F19引脚的 MCU_OSPI0_CS#信号被拉低、但该信号在原理图中具有10K 上拉电阻器。 在正常情况下、在加电完成前无法选择 OSPI 芯片。 是否可以通过软件配置将其更改为默认上拉?

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    根据  TRM 中 CTRLMMR_WKUP_PADCONFIG11的寄存器定义、引脚 F19在复位后未默认启用内部上拉电阻。  但是、引导 ROM 可能会根据所选的引导模式重新配置引脚。 选择了哪种引导模式? 请参阅 TRM 中所选引导模式的"引脚使用"表、以确定如何配置引脚。

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    您好!

    客户发现此问题是由外部 PU 不工作引起的。 关闭。 谢谢