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[参考译文] PROCESSOR-SDK-J721S2:TDA4VE-Q1、J721S2关于 DSI DPDY REFCLK

Guru**** 2484615 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1446067/processor-sdk-j721s2-tda4ve-q1-j721s2-about-dsi-dphy-refclk

器件型号:PROCESSOR-SDK-J721S2

工具与软件:

尊敬的 TI:

如何对 DSI  DPHY TX PLL REFCLK 进行编程以从 OSC1引脚连接?

我们要将时钟更改为20MHz、以便实现 更灵活的应用。

DSI  驱动程序: RTOS SDK8.4

谢谢。

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    Terry、您好!

    您是否已将 OSC1与20MHz 连接? 这可以在控制模块寄存器  DPHY0_CLKSEL (偏移0x8310)中通过设置值0x1进行更改。

    此致、

    Brijesh  

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    你好 、Brijesh、

    感谢您的答复。

    我们应该修改哪个文件?

    您能否帮助提供相关文件路径?

    谢谢

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    Terry、您好!

    不确定应该在配置 DSI 之前执行的具体位置、因此您可以 在调用 DSS 驱动程序初始化之前尝试将其放入吗?  

    此致、

    Brijesh