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[参考译文] TDA4VH-Q1:引导功能

Guru**** 2479715 points
Other Parts Discussed in Thread: 66AK2H14

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1459238/tda4vh-q1-boot-capabilities

器件型号:TDA4VH-Q1
Thread 中讨论的其他器件:66AK2H14

工具与软件:

您好!

我阅读了 SPRSP79B 数据表文档和 SPRUJ52C TRM 文档。

我对 bootmode 和 MCU_bootmode 有几个问题:

  • 表4-5指的是 POST 功能、但我找不到每个功能所涉及的描述
    • 帖子造成的延迟是什么?
    • 如何利用 POST 结果? 是否有一个默认的"输出控制台"给出结果(例如 UART ?) . 它们是否只能通过 JTAG 查看?  

  •   当 MCU_ONLY=0时、我们可以在表4-10中找到一些 QSPI 引导配置: "PRIMAY boot mode config (6..4)" (解释为"PORT / RSVD/CSEL")、表4-17详细介绍了端口和 CSEL、但我们不知道 RSVD 的值是多少。 这是不是"不关心"? 或者我们应该强制引脚为"0"吗? 或"1"?

  • 在 考虑 SPI 引导(因此 MCU_ONLY=0且 Primary_BOOT_MODE_B_PIN=1)时、我们可以参考表4-11、但未提供所需的"BACKUP_BOOT_MODE_CONFIG"值

=> 是不是"关心"? 或者我们应该强制引脚为"0"吗? 或"1"?

  • 考虑 SPI 引导表4-22时、提供了模式0和模式3之间的可能选择、但我找不到任何解释每种模式的同步图
    • 哪一个是激活数据输出的 SPI 时钟边沿:上升? 还是下降?
    • 哪个是 SPI 时钟边沿捕获数据输入:上升? 还是下降?

数据表给出了一些开关特性(图6-98至6-103)、但 t 不十分清楚哪些适用于模式0、哪些适用于模式3。 您能解释更多吗?

  • 考虑 SPI 引导时、我们可以在表4-1中看到、提及的 SOC 外设唯一一个是 MCU_FSS0_OSPI0。 但是、我们可以在表4-22中发现、可以选择 PORT0或端口1。 您是否确认 Port1是否对应于 MCU_FSS0_OSPI1?  因此、表4-1中应提到哪些? 还是混合物?

  • 考虑 PCIe 引导表4-10和表4-46时、给出了一些可能的配置、例如保留/SSC/时钟
    • 你能解释什么应该是保留值:"不用考虑? 0? 或1?
    • 表4-46对"南南合作"没有任何解释。 在这种情况下、我们应该得出什么结论? 通过 PCIe 引导时、SSC 始终默认激活? 还是始终停用?
    • 关于"计时":  
      • 外部引脚的含义是什么? 您是否确认它是指 SERDESx_REFCLK (典型的100 MHz 频率)、其中"x"是 SERDES 的编号?
      • 内部时钟的含义是什么? 您是否建议 PCIe 时钟可以由内部 PLL 阐述? 在这种情况下、由于其他 PCIe 端点应该接收外部时钟、因此只能用于根端口? 不是吗?

感谢你的帮助

此致、

Bruno

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    Bruno、您好!

    user5039443 说:
    表4-17详述端口和 CSEL、但我们不知道 RSVD 的值是什么。

    RSVD 被保留。 这对您没有影响。

    [报价 userid="113256" url="~/support/processors-group/processors/f/processors-forum/1459238/tda4vh-q1-boot-capabilities "]
    • 在 考虑 SPI 引导(因此 MCU_ONLY=0且 Primary_BOOT_MODE_B_PIN=1)时、我们可以参考表4-11、但未提供所需的"BACKUP_BOOT_MODE_CONFIG"值

    => 是不是"关心"? 或者我们应该强制引脚为"0"吗? 或"1"?

    [报价]

    我认为该表应提及备份 SPI 配置的端口。 我会确认这一点、然后回复给您。

    [报价 userid="113256" url="~/support/processors-group/processors/f/processors-forum/1459238/tda4vh-q1-boot-capabilities ]数据表给出了一些开关特性(图6-98至6-103)、但 t 不十分清楚哪些适用于模式0、哪些适用于模式3。 =>您能解释更多吗?

    您能告诉我数据表的版本和对应的部分吗?

    对于其余的问题、我会在几天后进行回复。

    此致、
    Tanmay

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    谢谢你 Tanmay 的初步答复

    如我的帖子所述、我引用的是 SPRSP79B (2023年2月)数据表文档和 SPRUJ52C TRM 文档。

    数据表第 6.10.5.19.1.2.1节开始的图6-98至6-103

    此致、

    Bruno

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    Bruno、您好!

    我认为该表应提及备份 SPI 配置的端口。 我将确认这一点并回复您。

    是的。 引脚7将在备份 SPI 模式下控制该端口。 0对应端口0、1对应端口1。

    请参见以下内容的脚注:

    [报价 userid="113256" url="~/support/processors-group/processors/f/processors-forum/1459238/tda4vh-q1-boot-capabilities "]
    • 考虑 SPI 引导表4-22时、提供了模式0和模式3之间的可能选择、但我找不到任何解释每种模式的同步图
      • 哪一个是激活数据输出的 SPI 时钟边沿:上升? 还是下降?
      • 哪个是 SPI 时钟边沿捕获数据输入:上升? 还是下降?

    数据表给出了一些开关特性(图6-98至6-103)、但 t 不十分清楚哪些适用于模式0、哪些适用于模式3。 您能解释更多吗?

    [报价]

    模式0与模式3仅对应于控制器侧和空闲时钟电平的数据采样。 在模式0中、数据在 前沿采样、空闲时钟为低电平。 在模式3下、数据在 后沿采样、空闲时钟为高电平。 我认为数据表中没有这方面的任何时序图。

    你可以看看这里的图表,而不是: https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/772490/faq-ads129x-what-are-the-correct-polarity-and-phase-cpol-cpha-spi-settings

    [报价 userid="113256" url="~/support/processors-group/processors/f/processors-forum/1459238/tda4vh-q1-boot-capabilities "]考虑 SPI 引导时、我们可以在表4-1中看到、提及的唯一 SOC 外设是 MCU_FSS0_OSPI0。 但是、我们可以在表4-22中发现、可以选择 PORT0或端口1。 您是否确认 Port1是否对应于 MCU_FSS0_OSPI1?  因此、表4-1中应提到哪些? 或者我是不是把东西混在一起?

    正确、端口1对应于 MCU_FSS0_OSPI1。 表4-1中缺少该值。 我将让团队了解这一点、以便在未来的版本中纠正该问题。

    此致、
    Tanmay

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    您好、Tanmay、

    我有点困惑,因为你所指的时间图是从从一个角度。 这不能说明何时从 MCU 主站输出数据、以及 MCU_MASTER 何时对数据进行采样。

    计算最大可能频率以及给定频率(对于主器件写入和主器件读取)下的裕度时需要精确的计时特性

    作为 T. 66AK2H14的产品说明书示例 我(我们最近使用的)精确地规定了以下内容:

    此致、

    Bruno

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    Bruno、您好!

    为了对问题的 PCIe 部分做出评论、我们目前不支持从 PCIe 引导。 正如 TRM 提到的、硬件具有 PCIe 引导功能、但不支持任何软件。

    此致、

    Takuma

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    Bruno、您好!

    如果有更详细的图、让我看一下。

    此致、
    Tanmay

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    Bruno、您好!

    user5039443 说:

    下面是我们得到的 w.r.t HWPOST 的内部测量数据。

    默认值

    MCU_PORz (上升)到 MCU_RESETSTATz (上升)

    发布00

    44.2ms

    Post 01.

    23.8ms

    员额10.

    23.8ms

    员额11.

    576us

    此数据基于使用示波器进行的测量、因为 HWPOST 在 ROM 开始运行之前就会运行。  

    user5039443 说:
    如何利用 POST 结果? 是否有一个默认的"输出控制台"给出结果(例如 UART ?) . 它们是否只能通过 JTAG 查看?  [报价]

     CTRLMMR_WKUP_POST_STAT (0x4300_C2C0)通常应在成功完成时读取0x103、而不设置其他超时或错误位。 这至少表示帖子完成。 如果您绕过 POST、此寄存器将读数为0。 LBIST_TIMEOUT/FAIL 位确实用于指示故障、在成功情况下这些位预计为0。 LBIST_MISR 寄存器将保存计算值、LBIST_SIG 寄存器将具有预期值。 然后、将 LBIST 计算出的 MISR 值与预期的 MISR 值进行匹配、以真正指示 LBIST 成功。

    您可以使用 SDL_LBIST_getPOSTStatus() API 从 SW - https://software-dl.ti.com/jacinto7/esd/processor-sdk-rtos-j784s4/08_06_00_14/exports/docs/sdl/sdl_docs/userguide/j784s4/modules/lbist.html#example-usage 获取 HWPOST 的结果

    此致、

    Josiitaa.