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[参考译文] AFE7950：将串行器/解串器流映射到 JESD204帧组件

admin
Guru**** 2470720 points
Other Parts Discussed in Thread: AFE7950-SP

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/rf-microwave-group/rf-microwave/f/rf-microwave-forum/1214819/afe7950-mapping-serdes-streams-to-jesd204-frame-assembly

器件型号：AFE7950

串行器/解串器通道的配置方式如何？ 数据表指出、多路复用器可以将任何 ADC 映射到任何串行器/解串器通道、而未使用的通道可以断电。 如果我只使用一个 ADC、我是否能够通过4或8个 JESD 通道传播数据以降低数据速率？ 或者我是否仅受表中列出的配置限制？ ( 顺便说一下、我正在查看 AFE7950-SP 和 AFE7950-SEP 的数据表)

谢谢！

  • 0
    TI__Guru**** 2470720 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Bill、

      最多可通过4个 JESD 通道发送一个 ADC 数据。 这受可用的 JESD 帧汇编模式的限制。  AFE79xx 还具有交叉开关多路复用器 、可 将任何特定的通道数据映射到八个物理通道中的任何一个。  

    此致、

    Vijay

  • 0
    TI__Guru**** 2470720 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    嗨、Vijay、

    感谢您的快速响应！

    只是为了说明一下、我可以将一个 ADC 的数据分布在四个通道中、而将其他三个 ADC 关闭？ 我之所以提出这个问题、是因为我认为这应该会降低我们 FPGA 的数据速率并可能降低功耗。

    此外、您能否帮助我了解可用的 JESD 帧汇编模式为何存在限制？ 为什么只有帧汇编模式可用于表中列出的模式？

    谢谢。

    法案

  • 0
    TI__Guru**** 2470720 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Bill、

    Unknown 说：
    只是为了澄清，我可以使用一个 ADC 的数据分布在四个通道上，而关闭其他三个 ADC？

    可以。

    Unknown 说：
    我问，因为我认为这应该会降低我们 FPGA 的数据速率和潜在功耗。

    与以较低的通道速率使用更多通道相比、使用较少的 SERDES 通道和关闭未使用的通道通常可节省更多功耗。  

    Unknown 说：
    此外，您能帮助我理解为什么对可用的 JESD 帧汇编模式存在限制吗？ 为什么表中列出的帧汇编模式只有可用？

    数据表表格列出了 AFE79xx 中设计的所有模式。 因此只能使用这些模式。

    此致、

    Vijay