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https://e2e.ti.com/support/sensors-group/sensors/f/sensors-forum/610208/iwr1642-what-s-the-frequency-of-osc_clkout-a14
您好！
在数据表中、它只解释了 OSC_CLKOUT 是清理 PLL 后时钟子系统的基准时钟输出。 但频率是多少？ 它是否会根据芯片配置而变化、还是固定频率？
谢谢、
您好 Chris、
我们已经向其中一位设计人员询问了与时钟子系统的 TRM 图3-1相匹配的功能和位定义。 根据 Vivek 的描述、初步答案是 OSC_CLKOUT 频率 与 APLL 输出频率匹配、并且分频器已编程。
在 IWR14器件中、APLL 频率将基于高速外设 HSI (LVDS/CSI-2)。
如果外部晶振频率为40MHz、输出为1800Mhz、则反馈分频器为45。 在本例中、OSC_CLKOUT 将为1800Mhz。
我认为将此信号分频回< 150Mhz 以供单端 CMOS 使用是一个更好的主意。
在数据表 IWR16中、在引脚多路复用表的表4-1 K13下、您可以使用 addrexx 0xFFFFFFEA64选择 PMIC_CLKOUT
对于2MHz 输出、我认为合适的分频器是1800/2=900。
当设计人员提供了更多信息时、我们将发送更多更新。
此致、
Joe Quintal
