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当输入目标频率为6.0GHz 时、如何选择采样率、数据速率和时钟源?
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当输入目标频率为6.0GHz 时、如何选择采样率、数据速率和时钟源?
您好、Michael、
在 TIDA-01022硬件中 、 将配置 LMK61E2、LMK04828和 LMX2594以生成 ADC 时钟。
要根据 ADC 器件时钟(ADC_DEVCLK)要求和用于捕获的 SERDES 通道计算的 ADC_SYSREF、FPGA_CORRClK、FPGA_REFCLK 和 FPGA_SYSREF。 为了实现6.4GSPS 采样率、板载时钟解决方案生成了以下时钟。
ADC_DEVCLK = 3.2GHz;以6.4GSPS 单通道模式运行 ADC
ADC_SYSREF = 40MHz
FPGA_CORECLK = 320MHz
FPGA_REFCLK = 320MHz
FPGA_SYSREF = 40MHz
串行器/解串器通道速率= 8
LMX2594-A 和 LMX2594-B 器件均配置为从 OSCIN 输入端的40MHz 基准为 DEVCLK 在 RFOutA 上生成3.2GHz、为 SYSREF 在 RFOutB 上生成40MHz 基准、OSCIN 输入通过 LMK00304时钟缓冲器连接到 LMK04828器件的 OSCout。
ADC12DJ3200数据表中8.3初始化设置下介绍的 JESD 通道 JMODE 选择的通用 ADC 配置文件生成。
1.在 J12 SMA 连接器处馈入输入信号
2.使用 USB2ANY 编程器通过 J32插头和 J62跳线将 LMK61E2编程为40MHz 基准生成
已删除。
3.使用 HSDC TID GUI"低级 PAGE 选项卡"对附加的配置文件进行编程、然后运行 HSDC Pro
用于 捕获数据的 GUI。
注:1. 附加的 JMODE0、3.2 DCLK、6.4GSPS 单通道模式文件
2.进一步的硬件设置、请参阅 TIDA-01022用户指南中的(图19)和 SNR 测量测试