[参考译文] CC1310：电路板堆叠问题

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器件型号：CC1310
主题中讨论的其他器件： CC1190

CC1190评估板和 CC1310评估板都使用 CC1310芯片、并且都将射频走线设置为0.4mm。但是、两个板之间的层叠(从顶部到内部1)差别很大。 CC1190似乎在0.4mm 时正确设置为50欧姆、但 CC1310评估层叠发生了什么情况、我对此有何损失？文档包是否错误？

参考板 cc1190和 cc1310具有不同的电介质厚度。我应该使用哪一层堆叠作为 CC1310的参考？

1．这是 CC1190 EVM 板

2.这是 CC1310 EVM 板。

0 admin 5 年多前

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如果您的电路板上只有 CC1310 (无 CC1190)、则应使用0.175mm 作为第1层和第2层之间的距离。

为了最大限度地减小寄生电容、电路板上的堆叠与 CC1190不同。

0 admin 5 年多前

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对我来说、没有意义的是使用50欧姆的迹线来运行 CC1310和 CC1190、这些迹线的计算结果不是50欧姆。这违背了射频和微波设计理论。虽然我很感激您可能希望最大限度地减少寄生效应、但不使用50欧姆的迹线毫无意义。

问题是、我有一个板将用于这两种情况、无论是 CC1310本身、还是 CC1310与 CC1190。因此、我需要知道如何正确地设计它。

谢谢、
Nick

0 admin 5 年多前

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请注意、设计中唯一50欧姆的点是进入/离开 SAW 滤波器并朝向天线。这些走线太短、不能视为传输线、这意味着走线的宽度实际上无关紧要。

这是否意味着您不打算在某些电路板上安装 CC1190并在带0欧姆电阻器的 SAW 滤波器后面放置天线？

低于 1GHz（参考译文帖）(Read Only)