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[参考译文] Linux/TLV320AIC3104：为MCLK提供20MHz时钟，而不是22.5792MHz

admin
Guru**** 2362820 points
Other Parts Discussed in Thread: TLV320AIC3104
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/580803/linux-tlv320aic3104-supply-20mhz-clock-to-mclk-instead-of-22-5792mhz

部件号：TLV320AIC3104

工具/软件：Linux

音频编解码器团队，您好！


在AM572x TI EVM上，我们将McASP3 (从机)连接到TLV320AIC3104 (主机)。 此外，我们还为AIC3104 MCLK提供了从AM572x clkout2引脚到AIC3104 MCLK的22.5792MHz时钟。

我们的客户设计了定制板，其中使用引脚mcasp3_ahclkx (而不是clkout2)为AIC3104 MCLK提供20MHz。 客户使用4.41万 Hz采样率。

请问我们是否可以将MCLK输入频率从22.5792MHz更改为20MHz，而无需对aic3x驱动程序进行任何修改？

此致，
Pavel

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    TI__Guru**** 2362820 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好，Pavel，

    在这种情况下，需要修改驱动程序。 如果AIC3104接收到20MHz MCLK，则需要配置内部PLL。 基本上，采样率的时钟频率倍数(在本例中为11.2896MHz，22.5792MHz)不需要PLL。 其余频率需要PLL调整。

    此致，
    Luis Fernando Rodríguez ñ o S.
  • 0
    TI__Guru**** 2362820 points
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    Luis，

    感谢您的回答，非常有帮助。

    我看到AM335xEVM和AM437x EVM具有AIC3106 (非AIC3104)，并使用12MHz时钟为AIC3106 MCLK供电。 您能否建议我们是否可以为AIC3104 MCLK提供12MHz时钟，以获得4.41万 Hz的采样率并使用默认的AIC3x驱动程序？

    我看到AM335xStarterkit和AM437x Starterkit具有AIC3106 (非AIC3104)，并且使用24MHz时钟为AIC3106 MCLK供电。 您能否建议我们是否可以为AIC3104 MCLK提供24MHz时钟，以获得4.41万 Hz的采样率并使用默认的AIC3x驱动程序？

    我看到AM335x在默认情况下支持此采样率4.41万 Hz，并为AIC3106提供12/24 MHz时钟：
    processors.wiki.ti.com/.../AM335x_Audio_Driver's_Guide

    此致，
    Pavel
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    TI__Guru**** 2362820 points
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    您好，Pavel，

    在这种情况下，如果AIC3104与AIC3106共享相同的配置/驱动程序，则可以获得4.41万Hz采样速率并提供12/24MHz时钟。 AIC3104和AIC3106共享相同的PLL和时钟配置寄存器。 因此，默认驱动程序应该将采样率配置为12和24 MHz (实际上，在我们的主板中，精确值为12.288MHz和24.576MHz)。

    此致，
    Luis Fernando Rodríguez ñ o S.
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    TI__Guru**** 2362820 points
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    Luis，

    感谢您的回复。

    因此，默认驱动程序应该能够将采样率配置为12和24 MHz (实际上，我们的主板上的精确值是12.288 MHz和24.576 MHz)。[/QUOT]

    您的意思是在AM335xEVM和Starterkit中，我们提供12.288MHz (非12.000MHz)和24.576MHz (非24.000Mhz)吗？ 请您提供更多有关这一点的信息吗？ 在AM335xPSDK中，我认为我们提供12.000MHz和24.000Mhz

    此致，
    Pavel

  • 0
    TI__Guru**** 2362820 points
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    您好，Pavel，

    12.288MHz和24.576MHz是标准时钟值，通常出现在我们的编解码器应用中。 这些值不需要PLL系数计算，因为这些频率是48kHz (48*256和48*512)的倍数。 对于44.1kHz采样率，使用11.2896MHz和22.5792MHz。

    如果使用12MHz和24MHz，则必须配置PLL。 如数据表所述，PLL将需要额外的电流消耗。 因此，我们的主板时钟通常使用256或512系数。

    此致，
    Luis Fernando Rodríguez ñ o S.