[参考译文] LMK00301EVAL：相位噪声问题

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1509059/lmk00301eval-phase-noise-question

器件型号：LMK00301EVAL
Thread 中讨论的其他器件：LMK00301

工具/软件：

尊敬的先生或女士：

发生正转换

我使用50欧姆源100 MHz 正弦信号驱动 CLKin0引脚。我放置在 R30 50 Ω 和 C10 100nF 上。我移除了100 Ω R24。 CLKin0*端接50 Ω。 R28和 R22是100nF 电容器。所以输入是交流耦合的。

输出：

我测量 CLKouA0 (配置了 LVPECL)上的 SE、测量50欧姆端接 PN 仪器上信号的绝对相位噪声。 CLKoutA0*在 SMA 连接器上端接50欧姆。在 SMA 连接器之前、输出会通过160欧姆+交流耦合超过100nF 下拉至 GND (默认评估板配置)

相位噪声达到 APP。 -120dBc/Hz 白色(意外损坏)。输出没有50%的占空比。输入是-170dBc/Hz 源。

好的,我可以想象,通过差分驱动输入,并使用两个输出在一个比较块上进行测量,它会有所帮助。但即使这(假设增益为12dB、可能为20dB)也无法达到预期的 <-160dBc/Hz 本底噪声。

有什么想法我做错了?

好极了。

5 个月前

0 admin 5 个月前

TI__Guru**** 2382480 points

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您好：

您说的是正弦波、意思是 SE。

有关正确的 SE 输入端接、请参阅附件。

此致、

Vicente

0 admin 5 个月前

TI__Guru**** 2382480 points

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您好、

是的、这是我所做的。请阅读我上面的文本以获取结果。

此致。

0 admin 5 个月前

TI__Guru**** 2382480 points

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尊敬的 Gruffalo：
未使用的一侧是否偏置到 VDD /2？

这将通过为 CLKin0组装 R26和 R30来完成。

此致、

Vicente

0 admin 5 个月前

TI__Guru**** 2382480 points

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尊敬的 Vicente：

我明白了。因此、如果我理解正确、LMK00301就没有用于输入的内部偏置。是否应始终在外部正确提供？

好极了。

0 admin 5 个月前

TI__Guru**** 2382480 points

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尊敬的 Gruffalo：

正确。

此致、

Vicente

0 admin 5 个月前

TI__Guru**** 2382480 points

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尊敬的 Vicente：

感谢你的帮助。

我已将两个输入(CLKin0和*)偏置为82 Ω(至3.3V)和130 Ω(至 GND)。端子上的电压现在为2V。除两个输出外、我已关闭整个 A 组。我在 LVPECL 输出设置了 A 组。输出默认偏置、连接到 GND 160 Ω。

我使用-180dBc/Hz 100 MHz 正弦源以差分方式驱动输入。

我正在重新组合 diff。通过变压器输出到 SE、然后我使用 PN 仪器测量相位噪声。我得到的最佳结果是-158dBc/Hz 白色。数据表声称为-162dBc/Hz。

我尝试将输入差分电压从1.2Vpp、2Vpp 增加到2.7Vpp。相位噪声的表现更佳、大致与功率增加时相同。

我从数据集的理解是、2.7Vpp 已经接近上限或允许的范围(绝对最大高度)。

您是否看到了有关如何将相位噪声改善数据表中指定的这些额外4dB 的其他技巧？

好极了

0 admin 5 个月前

TI__Guru**** 2382480 points

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如果相位随着振幅的增加而增加、我怀疑问题出在源头上。
正弦波的压摆率比方波差。我建议首先利用低附加抖动时钟缓冲器将源转换为方波。

使用 LMK1C 等器件将有所帮助、因为它具有非常好(低)的本底噪声。
使用时钟缓冲器进行正弦波-方波转换

您在这里使用的参考时钟的 PN 是什么？我想看看 DS。

此致、

Vicente

0 admin 5 个月前

TI__Guru**** 2382480 points

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尊敬的 Vicente：

已附加源图。不应该是问题所在。

好的、方波输入可能是后续要尝试的操作之一。

感谢您对 LMK1C 系列的提示。

时钟和时序（参考译文帖）

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