[参考译文] 原理图审阅

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Other Parts Discussed in Thread: SN74LVC1G74

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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/737047/schematic-review

器件型号：SN74LVC1G74

您好！

我的设计如下所示、但无输出、VCC 和 VIN 是正常的。

您能在我的原理图中给我一些建议吗？

谢谢。

7 年多前

0 admin 7 年多前

TI__Guru**** 2933120 points

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您好、Wu、
我真的不能说出这个小范围镜头的情况--你能提供包括计时和电压设置在内的完整范围镜头吗？

从您提供的微小片段中可以看出、输入在大约 Vcc/2处暂停、这对于 SN74LVC1G74等 CMOS 器件而言非常糟糕。

0 admin 7 年多前

TI__Guru**** 2933120 points

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您好！
我已经更新了波形。
谢谢。

0 admin 7 年多前

TI__Guru**** 2933120 points

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谢谢您、Wu、
在有效信号上，我可以清楚地看到时钟输入在大多数上升沿以大约1/2*Vcc 的频率停止约50-100us。对于 CMOS 器件、这是_非常糟糕_。它将导致过多的电流、热量、振荡、并可能损坏器件。

在"invalid signal (无效信号)"示波器屏幕截图中、我无法真正判断发生了什么情况。您的时间刻度为500us、此器件在10ns 内响应。您能否放大时间刻度并查看输出触发时发生的情况？