[参考译文] DRV3946-Q1：为什么 SDO 最大输出逻辑低电平电压为 0.3V、而不是 0V？

admin

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器件型号： DRV3946-Q1

尊敬的专家：

客户测试 DRV3946 SDO 输出低电压为 0.26V。 SDO 是推挽式架构。您能否帮助检查是否存在内部电阻器、以及为什么 SDO 低电压为 0.3V、而不是 0V？

为了更详细地表达客户的问题、我绘制了简单的电路。客户测试 R2 电压以获得灌电流。它们还会探测 SDO 低逻辑电压 IN 引脚。根据计算结果、它们得到内部阻抗为 127 欧姆。因此、他们想知道 SDO 中是否存在真正的内部电阻器。如果不是、为什么我们设计 0.3V 作为最大 SDO 输出低电压。

0 admin 3 个月前

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尊敬的北大：

感谢您问这个问题。以下是我的评论

在实际系统图中、R1 应直接连接到 SDO 引脚、R2 应从 SDO 连接到 MCU 侧。如果这有道理、请告诉我。

回到低电压、我查看了表征数据来查看实际数字、看起来远低于 300mV。直方图显示、批次、温度等范围内的电压小于 30mV

谢谢、

Ibinu

0 admin 3 个月前

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尊敬的 Ibinu：

是的、您是对的。 R2 通过电平转换器连接到 MCU。我知道实际测试数据低于 300mV。实际上、客户无法理解为什么低逻辑电压不是 0V 或 0.1V。他们认为 SDO 的内部部分有一个电阻器、如 R1 出口。您能否帮助进行检查、并从内部电路方面找出导致 0.3V 退出的原因？

0 admin 3 个月前

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尊敬的北大：

低侧 FET 上会有一些电阻、导致出现此电压。如前所述、实际器件电压实际上远低于 300mV。

谢谢、

Ibinu

0 admin 3 个月前

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Ibinu,

感谢您阐明电压。您有电阻值吗？是关于 100Ω 等级吗？

0 admin 3 个月前

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您好、北大、从数据来看、它看起来大约是 60 欧姆。

谢谢、

Ibinu

0 admin 3 个月前

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谢谢、Ibinu。

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