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尊敬的所有人:
我们将使用与 DRV8305-Q1EVM 相同的电路来处理工作样片。
我在测试过程中有疑问。
区别在于电源 A 和电源 B 是分开的。
对于电源 A (12V)、依次降至5V 和3.3V 和3.3V、再降至 MCU 电源
5V 电源连接到 DRV8305上拉电阻器和 Vref 的电源。
电源 B (12V)通过电源开关连接到 DRV8305的 PVDD。
问题)
电源 A 始终开启、电源 B 开启/关闭、以便根据电源 B 的状态驱动电机
如果通过电源开关关闭电源 B、则在上拉时 PVDD 变为5V-0.4V、在 Vref 上施加5V 电压、并在施加3.3V 电压时将其保持在3.3V-0.4V。
我想知道 Vref 的电压是否会影响 PVDD。
谢谢。
尊敬的 Mike:
是的、由于 DRV83053xx 和 DRV83055xx 版本的 IC 中存在 LDO、因此 IC 上存在从 VREF 到 PVDD 的内部二极管路径。 我们正在更新数据表的应用部分以反映这一点。
添加的部分以进行说明:
VREG 基准电压输入(DRV8305N)
对于 DRV8305N、VREG 引脚用于电流感应放大器和 SDO 上拉电阻的基准电压、如"7.3.7 VREG:稳压器输出"中所述。 内部 LDO 被禁用、但 LDO 在物理上存在于器件中、并且有一条通过内部 LDO 从 VREG 引脚到 PVDD 引脚的电流路径。 如果 PVDD 电压(VPVDD)高于 VREG 引脚电压(VVREG),数据表中指定的基准电流将流向器件。 如果在加电/断电序列期间 VVREG 高于 VPVDD、建议通过向 VREG 引脚添加电阻器来限制电流、从而使电流不超过50mA。 图 xx 使用330ohm、当 VVREG = 5V 且 VPVDD = 0V 时、该电阻器有助于将电流限制在大约15mA。