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[参考译文] TPS7B81-Q1：哪个 LDO 规格决定了从1.25V 降至0.3V 所需的时间

admin
Guru**** 2493545 points
Other Parts Discussed in Thread: TPS7B81-Q1

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1486613/tps7b81-q1-which-spec-of-ldo-determines-the-time-needed-to-drop-from-1-25v-to-0-3v

器件型号：TPS7B81-Q1

工具与软件：

嗨、团队：

固定负载和输出电容。  客户观察到、当禁用输出时、从 1.25V 下降 到0.3V 需要166ms、客户认为他们的 MCU 需要更长的时间。 他们发现、不同供应商的 LDO 在从 1.25V 到 0.3V 的时间之间具有很大差异、他们在同一个电路板上对其进行了测试。

支持需要：

  • 对于固定负载和电容、LDO 的规格决定了从 1.25V 下降 到 0.3V 所需的时间

谢谢！

Jayden Li

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    TI__Guru**** 2493545 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Jayden：

    一些器件具有有源下拉机制、有助于在器件被禁用时使输出放电、另一个器件可能具有该特性。 TPS7B81-Q1没有有源下拉、因此当器件禁用时、通道闭合(变为高阻抗)、输出根据负载和输出电容情况下降。 它们使用的负载和输出电容器是多少？

    此致、

    Nick

  • 0
    TI__Guru**** 2493545 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Nick。

    他们测试的所有 LDO 都没有有源下拉。 负载是 MCU、他们确认它们在同一个板上进行了测试、因此电容和 MCU 负载完全相同。 他们想了解芯片内部的什么会影响时序？ 例如内部分压电阻器？

    谢谢！

    Jayden Li

  • 0
    TI__Guru**** 2493545 points
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    尊敬的 Jayden：

    很抱歉延迟了响应。 如果没有负载(例如、MCU 关闭后)、则可以预期主放电路径为电阻分压器。 可能还有一些其他高阻抗泄漏路径会因器件而异、但我希望电阻分压器是阻抗最低的泄漏路径。  

    此致、

    Nick