[参考译文] TPS3431：TPS3431SDRBR

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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1540513/tps3431-tps3431sdrbr

器件型号：TPS3431

工具/软件：

尊敬的团队：

我们在设计中使用的是 TPS3431SDRBR 看门狗、如下图所示。 SET1 和 WDI 引脚由 CPU 控制、CWD 引脚生成 900 毫秒（最大值）使用 10nF 电容器时的看门狗超时 (TWD)。

WDO 引脚连接到 CPU RESET 引脚 POR_X、SET1 引脚下拉。

测试观察：

通过将 SET1 引脚设置为高电平并且未应用 WDI 脉冲来启用 WDT、在 834ms WDO 置为低电平且 CPU 复位后、因此禁用看门狗、并且由于此复位延迟时间 (TRST) 仅在 100us 内保持低电平。

问题 1：在上述配置下、最短复位延迟时间 (TRST) 是多少。

问题 2：是否可以小于 100us？（例如 1us 或 10us 等）

有关波形的详细信息、请参阅随附的文件。

e2e.ti.com/.../TRST_5F00_Watchdog.docx

此致、

Sanju

3 个月前

0 admin 3 个月前

TI__Guru**** 2448780 points

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尊敬的三州：

对于 TPS3431、您可以通过在 WDO 置为有效期间将 EN 引脚拉低来截断 WDO 信号。例如、导线 ORing EN 和 WDO。这将将 WDO 脉冲减少至~200ns、EN 到 ENOUT 延迟。

Jesse

0 admin 3 个月前

TI__Guru**** 2448780 points

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您好 Jesse：

感谢您的答复、

但在 WDO 置位期间、我们不会将 EN 引脚拉至低电平。

当 SET1 引脚从高电平转换为低电平时、我们需要 WDO 置位为高电平到低电平、从低电平到高电平的最短时间 (tRST)。（请参阅下面的波形）

因为当 WDO 置为低电平时、CPU 会复位、因此 SET1 引脚置为低电平、WDT 会被禁用。

此致、

Sanju

0 admin 3 个月前

TI__Guru**** 2448780 points

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尊敬的三州：

遗憾的是、我们没有这种情况下的最小值、SET1 设置时间的典型值只有 1us。是的、SET1 引脚变为低电平也会截断 WDO 信号。

Jesse

0 admin 3 个月前

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嗨、Jesse

是的、SET1 引脚变为低电平会禁用 WDT、并也会截断 WDO 信号。

但是、当 SET1 变为低电平时、从该时间点到 WDO 置为高电平、所需的最短时间是多少。

此致、

Sanju

0 admin 3 个月前

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我们没有最短时间的规格、但典型值将是 SET1 设定时间、即 1us。

Jesse

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