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[参考译文] LM74502:更大限度地减少 VEN 激活和栅极电压上升之间的延迟

Guru**** 2540720 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1566482/lm74502-minimizing-delay-between-ven-activation-and-gate-voltage-rise

器件型号:LM74502


工具/软件:

您好、

我们使用 LM74502QDDFRQ1 IC 来驱动两个背对背连接的 NMOSFET (NVMFS5C673NLAFT1G)、其输入电容 (CISS) 为 880 pF。  我们选择了 10nF 的 VCAP 电容器、输入电源电压为 14V  

但是、我们观察到、IC 需要大约 1ms 的时间使 VEN 信号栅极上升。 您能帮助我们了解如何缩短上升时间吗?

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    尊敬的 Jeevabharathi:

    建议的最小电容为 100nF、请勿使用 10nF。

    接下来、无法通过 EN 信号缩短该时间。

    您可以尝试使用 OV 而不是 EN 上电、从而加快导通速度。

    此致、

    Shiven Dhir

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    尊敬的 Shiven Dhir:

    我们将 VCAP 电容器更新为 0.22 µF 。 不过、我们观察到了栅极电压最初无法完全导通的问题。 它最初脉冲至 8V 左右 、只有一段时间后才会完全上升至 23V  

    我们已将 OV 连接至 GND 和 VS - 13.5V。

    已附上图像以供参考。

    我们还尝试进一步降低 VCAP 值、但问题仍然存在。

    请帮助我们纠正此问题。  

    谢谢你。

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    尊敬的 Jeevabharathi:

    请探测 VCAP-VS、GATE-SRC 并确认其行为。

    此致、

    Shiven Dhir

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    尊敬的 

    请找到随附的图像以供参考。

    以下探测期间使用的 VCAP 为 0.1uF

    1) 在栅极脉冲时间的 VCAP-VS 电压约为 7V(红色通道: VCAP - VS)

    2) 其中作为 GATE-SRC 电压约为 3.8V (红色通道: VGATE-VSRC)

    请分享您对此的想法。

    谢谢您、

    Jeevabharathi

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    尊敬的 Jeevabharti:

    请另外分享您的原理图。

    此致、

    Shiven Dhir

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    尊敬的 

    由于我们目前处于评估阶段、因此尚未提供详细的原理图。 不过、我可以分享一下在我们的验证过程中使用的粗略电路图。 请找到随附的图像以供参考。

    期待您的答复。

    谢谢您、

    Jeeva.

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    尊敬的 

    您能帮助我们了解 VCAP 低于 0.1uF 时可能会发生什么情况吗?

    谢谢、

    Jeeva.

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    尊敬的 Jeeva:

    0.1uF 作为设计的最低要求、不建议低于该值。

    对于您的问题、VCAP 值和 COUT 是多少?

    请尝试添加一些 10-22 欧姆的栅极电阻器、然后再次进行测试。

    此致、

    Shiven Dhir