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大家好、TI、 在我的设计中、我使用了两个并联 MOSFET (800V 17A 器件型号 TK17A80W)和 变压器初级电感:55uH
我更改了缓冲器值、但过冲没有影响。 仍然过冲在750V 左右很高。 此处、我要附上我现在在设计中使用的计算表和组件详细信息。 请看一下。 如果我有任何问题 、请提出建议。
此致。
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大家好、TI、 在我的设计中、我使用了两个并联 MOSFET (800V 17A 器件型号 TK17A80W)和 变压器初级电感:55uH
我更改了缓冲器值、但过冲没有影响。 仍然过冲在750V 左右很高。 此处、我要附上我现在在设计中使用的计算表和组件详细信息。 请看一下。 如果我有任何问题 、请提出建议。
此致。
尊敬的 Ravi:
如果过冲意味着初级 FET VDS 尖峰,您可以参阅以下几个文档进行缓冲器调优。
https://training.ti.com/power-tips-snubbing-flyback-converter
大家好、参考上述文档后、现在在260Vac 时过冲降至670V。
查询: 在这里、我在输出 侧使用48V 电池、当电源电压为@230VAC 时、我在输出侧同时获得58.8V、当我的负载 打开时、输出电压会下降(有时为0V 至58.8V)、VCC 在20V 左右处于高电平(图像、已连接)。 此外、当持续打开和关闭负载时、我的电压会降至10V、然后降至58.8V (图像、已连接)。
请建议我需要关注哪个部分来解决上述问题。
您好!
回答- 1反激式输出和电池输入之间是否有任何保护电路?
是在 反激式输出和电池输入之间添加了10A 直流保险丝。 此外、出于测试目的、我添加 了电阻负载(变阻器)。
答复2 对于第二个波形,Vdd 电压仍与第一个波形相同。
在这里、当负载打开时、Vout 最初会降至0V、然后与电池电压相同。 同时、VDD 电压在22V 左右为高电平、在13V 左右为低电平。
答复3 如果反激式输出电压下降,Vdd 电压也会下降。
没有负载条件 电压是可以的、但当我连接负载 时、Vout 最初会降至0V、然后与电池电压相同。
Reply-4 根据计算器设置,PSA 大约为4,因此如果反激式输出电压降至10V,则 VDD 应降至2.5V。
这里是什么 PSA。添加图像 Vaux 和 Vdd 和 Vout (R49侧)
回答5 :您可以测量连接到 GND-2的 R46电压、以验证反激式输出电压是否下降。
结果仍然相同。 图像已附加
尊敬的 Ravi:
感谢您的附加波形,VDD 看起来除了 VAUX 还有其他源,因此即使 VAUX 下降,它仍会拉高。
您可以减小 R26电阻。 我认为 IC 应该在负载打开期间触发恒定电流,或者您可以在输出侧添加更多电容器以保持输出电压。
顺便说一下,UCC28740 (QR 反激式)通常设计用于100W 以下的应用,但您的应用中的额定功率高达350W。
我建议您调查其他拓扑以处理它。
尊敬的 Ravi:
您可能可以参考以下适用于大功率充电器应用的参考设计。
如果您仍想使用350W 反激式应用程序,可以参考 LM5021。
它是 CCM 反激式控制器,因此有助于降低变压器和 FET 的峰值电流和 RMS 电流。
是的,大多数反激式参考设计都低于100W,您可以参考下面的链接。