大家好、
我的一位客户正在自己的 PCB 上评估 TPS65218D0。
他们在评估中面临 DCDC4未加电至3.3V 的问题。
该行为与以下 E2E 主题非常相似。
您能告诉我您对此胎纹的解决方案是什么?
非常感谢您的答复。
此致、
Kazuya。
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大家好、
我的一位客户正在自己的 PCB 上评估 TPS65218D0。
他们在评估中面临 DCDC4未加电至3.3V 的问题。
该行为与以下 E2E 主题非常相似。
您能告诉我您对此胎纹的解决方案是什么?
非常感谢您的答复。
此致、
Kazuya。
您好 Brian、
非常感谢您的回复、很抱歉我迟到了。
客户确认电源板已正确焊接到 GND PCB 布局。
除了电源板未焊接外、您是否知道导致 DCDC4不启动的任何原因?
另外、您能否 回答以下其他问题?
问题1. 客户不使用 Load SW 1~3 (LS1~3)。
请告诉我如何处理相关 引脚(IN_LS1、LS1、IN_LS2、LS2、IN_LS3、 LS3)?
所有引脚应该连接到 GND 还是应该断开?
问题2. 如果 GPIO1和 GPIO3引脚 断开、是否存在任何问题?
问题3. 如果 GPO2连接到 GND、是否存在任何问题?
再次感谢、致以诚挚的问候、
Kazuya Nakai。
Nakai San、
您能否提供此设计的原理图以及显示其中一个 TPS65218D0 PHP 器件顶部标记的照片?
[引用用户="Kazuya Nakaia54"]
问题1. 客户不使用 Load SW 1~3 (LS1~3)。
请告诉我如何处理相关 引脚(IN_LS1、LS1、IN_LS2、LS2、IN_LS3、 LS3)?
[/报价]
IN_LSx 和 LSx 引脚应保持开路或两者均短接至 GND。 只要 IN_LSX 和 LSX 以相同的方式终止、就无关紧要。
[引用 user="Kazuya Nakaia54"] 第2季度。 如果 GPIO1和 GPIO3引脚 断开、是否存在任何问题?
对于 GPIO1、它默认配置为输出、因此开路很好。 对于 GPIO3、它被配置为输入并且不应保持悬空。 它应该被上拉至系统中的 VIO。 如果 GPIO3被视为低电平信号、它将导致 DCDC1/2上的热复位。 但这不会影响加电序列或 DCDC4的行为。
[引用 user="Kazuya Nakaia54"] 第三季度。 如果 GPO2连接到 GND、是否存在任何问题?[/报价]默认情况下、GPO2是输出、配置为推挽、高侧 FET 连接到 LS1。 如果 IN_LS1上没有连接、则不应导致任何问题。
我担心的是、您的原理图中还有其他原因导致了该问题。 除了查看故障 PCB 上的其中一个 PMIC 器件的顶部标记外、如果没有原理图可供查看、我再也不能提供任何帮助。
请分享一 张照片、其中显示 了 TPS65218D0 PHP 器件的正面标记。
制造了多少块 PCB? 有多少人遇到此问题? 换言之、故障率是多少?