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[参考译文] TPS5430:输出电压纹波和辐射测试中观察到的辐射

Guru**** 2534140 points
Other Parts Discussed in Thread: TPS5430

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/950475/tps5430-ripple-in-output-voltage-and-emission-observed-in-radiation-testing

器件型号:TPS5430

您好!

我在设计中使用了 TPS5430稳压器、详情如下:

部分 规格
输入电压 12伏
输出电压 3.3V
输入电容器

P/N - C3216X5R1H106K  

陶瓷10uF 16V

P/N - C1608X7S2A104K

陶瓷0.1uF 100V

输出电容器

P/N - T491D227K016AT  

钽220uF 16V

ESR - 500m Ω

电感器

P/N - ASPIIG-F1040-180m-T

屏蔽18uH、

DCR - 62m Ω

下图显示了上述设计的原理图。  

在空载或最小负载条件本身下、我们可以看到接近1V 的输出纹波。 请参阅以下输出电压波形。

在辐射测试期间、我们可以观察30MHz 下的发射及其谐波。 当我们使用频谱分析仪进行检查时、电感器附近的发射似乎更多。  

您能否就如何减少上述设计中的纹波和辐射向我们提出建议?

等待您的回复

谢谢、

梅纳卡

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    请参阅以下原理图和输出电压波形

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    你好

    请重新发送原理图和示波器图像。

    但我的第一个问题是、您将需要 ESR 低得多的输出电容器。

    和/或将输出电容器与陶瓷并联。

    谢谢

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    您好、Frank、

    感谢你的答复。

    请查找以下原理图和输出电压范围图像

    我们通过将输出电容器的 ESR 值更改为100m Ω 进行了检查、但纹波仍未降低。

    我们能否添加与钽电容器并联的陶瓷电容器? 我们应该在包括陶瓷电容器时包含补偿电路

    谢谢、

    梅纳卡

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    你好

    是的、您可以尝试将陶瓷与钽并联。

    您可能还需要在节点 VCC_3P3_SOM 处使用一些电容

    此外、检查电感器的自谐振频率。  尝试使用选择电感器  

    高自谐振频率、以减少从 PH 节点到输出的寄生电容。

    有关输出纹波的更多信息、请参阅随附的资源。

    谢谢

    e2e.ti.com/.../Understanding_2C00_-Measuring_2C00_-and-Reducing-Output-Voltage-Ripple-_2D00_-Simple-Sw_2E00__2E00__2E00_.pdf

    e2e.ti.com/.../3362.understanding_5F00_measuring_5F00_and_5F00_reducing_5F00_outputnoise_5F00_0.pdf

    https://training.ti.com/understanding-measuring-and-reducing-output-noise-dcdc-switching-regulators

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    你好

    由于不活动、我将关闭此帖子。

    如果您需要更多帮助、可以重新打开。

    谢谢

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    尊敬的 Frank:

    感谢您的建议。

    与陶瓷电容器并联时、输出纹波会降低。 在并联添加两个47uF 陶瓷电容器后、该电压降至约200mV。

    目前、我还在尝试其他方法来进一步降低纹波、我将获得更多结果。

    谢谢、

    梅纳卡

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    感谢 Menaka 的跟进。  

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    尊敬的 Frank / Denislav:

    请您澄清我的以下问题

    在使用示波器探测输出纹波时、如果我在示波器中选择 BW 限制、我可以看到纹波较小(差值接近200mV)。 您能解释一下吗?

    建议使用具有高自谐振频率的电感器、您能不能让我知道自谐振频率应该是多高、或者存在任何裕度?

    等待您回复

    谢谢、

    梅纳卡

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    您好、Menaka、

    以下是一些注释:

    1、示波器带宽限制主要过滤掉任何高频振铃/尖峰。 这就是您看到差异的原因。 一些高频尖峰可能是测量技术的伪影。 我相信这是在本文前面的一篇 PDF 文件 Frank 共享的内容中讨论的。 请参阅上文10月23日第一个链接中的"Understanding、Measuring、and Reducing Output Voltage Ripple" PDF。

    其理念是更高的自谐振频率、等效并联电容越小。 较小的电容将减少 SW 与 VOUT 之间的振铃/噪声耦合。 折衷可能是组件的物理尺寸。 我建议根据稳压器需求选择电感、并比较不同供应商提供的一些适合您应用尺寸的选项。 然后选择具有更高 SRF 的那个。

    不确定是否已经提到过它、但在 VCC_3P3_SOM 节点上的铁氧体磁珠之后、您可能应该有一个小电容器(例如1000pF)。

    但愿这对您有所帮助。

    谢谢、

    Denislav

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    尊敬的 Denislav:

    感谢你的答复。

    此致、

    梅纳卡

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    不用客气。