[参考译文] TPS650864：关于四向加电序列(&quot)；TPS6508641&quot；

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Other Parts Discussed in Thread: TPS544B25

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器件型号：TPS650864
主题中讨论的其他器件：TPS544B25

您好！

我正在开发安装了 Zynq UltraScale+ MPSoC (XCZU3EG-1SBVA484I)的原始 PCB。
我还采用了用于 Zynq UltraScale+的 PMU (TPS6508641)。我选择的芯片是否正确？

请参阅 TPS6508641的数据表。
如图6-9所示，当连接时，我认为它们无法满足“VCC_PSPLL”和“VCCC_PSIO”之间的 Zynq UltraScale+上电序列。
请查看下图。
我已从 DS925 (Xilinx 数据表)中检查上电顺序。
我的理解是否正确？

谢谢。

0 admin 4 年多前

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您好！

我的理解是、排序的关键部分是 VCCC_PSIO 不应在 VCC_PSAUX 之前上电、同时上电不会导致泄漏电流。

Xilinx 设计的 Ultra96板将它们短接在一起： www.96boards.org/.../ultra96-schematics.pdf

0 admin 4 年多前

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您好！

感谢您的快速回复！

您能否回答以下其他问题？

问题1.
在 Ultra96中，如下所示，TPS22920YZPRB (U31、U32)用于生成"VCC_PSINTFP"和"VCCINT"。这些器件与“加电/断电序列”相关。

问题2.
数据表中的滤波器、我如何编写它？我可以将其设为 Ultra96吗？

问题3.
在 Ultra96中、电源仅由 TPS6508641生成。
当我参考下一页时、VCCINT 由 TPS544B25生成。这是电流容量还是其他问题？

e2e.ti.com/.../843624
(Schematic PMIC_MPSoC_XCZU6CG.pdf)

谢谢。

0 admin 4 年多前

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您好！

对于 Q1、它取决于您想要使用的有关 PS/PL 的架构。我参考了本文档第34页中概述的 Xilinx 电源架构：www.xilinx.com/.../ug583-ultrascale-pcb-design.pdf

对于 Q2、我建议遵循 Xilinx 的示例。

对于 Q3、是的、它主要取决于 Q1的配置。如果 VCCBRAM = VCCINT、则它们可以合并。如果 VCCINT = 0.72V、则它们需要是单独的。

电源管理（参考译文帖）(Read Only)