[参考译文] TPS25942A：关于压降计算公式

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/794570/tps25942a-about-voltage-droop-calculation-formula

器件型号：TPS25942A

尊敬的 TI 团队：

我对 TPS25942A 数据表有疑问。

http://www.ti.com/lit/ds/slvsce9/slvsce9.pdf

在第36页上、有压降计算 V (压降)= I (负载) x 125us / C (总线)。

我将125us 视为开关速度、但它是如何在计算中推导出来的？

谢谢你

Naim

6 年多前

0 admin 6 年多前

TI__Guru**** 2387080 points

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您好、Naim、

欢迎使用 E2E！
让我检查一下这个、然后返回给您！

此致、
Rakesh

0 admin 6 年多前

TI__Guru**** 2387080 points

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您好、Naim、

如您所见、在优先级电源多路复用实现中、主器件的 PGOOD 馈送到辅助器件的 OVP。当 OVP 被拉至低电平时、辅助器件将被启用。
125us 是典型的 OVP 接通延迟(OVP =低电平到内部 FET 开始接通的时刻)。在此间隔期间、输出总线电容必须为负载供电。这是否回答了您的问题？

此致、
Rakesh

0 admin 6 年多前

TI__Guru**** 2387080 points

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您好、Rakesh

感谢您的回复。

我在时序要求和典型特性中都找不到125us。

我的第一个想法是、它与图8、9、10相关。

如果可能的话，我想详细了解每个阶段出现的延迟，以便判断我们的申请是否合适。

(例如：μ s 优先级路径 UVLO 启用延迟→ 优先级路径 PGOOD 低输出延迟→辅助路径 OVP 禁用延迟→辅助路径 FET 开启速度)

引述："125us 是典型的 OVP 开启延迟"

在最糟糕的工作条件下、它是否会超过125us？我可以知道最长延迟时间吗？

此致

Naim

0 admin 6 年多前

TI__Guru**** 2387080 points

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您好、Naim、

优先路径 UVLO 禁用延迟→优先路径 PGOOD 低输出延迟
PGTH 降至编程阈值以下10us 后。请参阅"图38。电源正常延迟(下降)"

优先级路径 PGOOD 低输出延迟→辅助路径 OVP 禁用延迟
优先级路径的 PGOOD 直接连接到辅助引脚的 OVP ->因此无延迟

辅助路径 OVP 禁用延迟→辅助路径 FET 开启速度
125us、请参阅"图36。 OVP 接通延迟"

遗憾的是、我们没有对该参数进行表征。此外、只有典型值可用于所有时序参数。

您能否分享您的系统要求和用例以在我的结尾进行检查

此致、
Rakesh

0 admin 6 年多前

TI__Guru**** 2387080 points

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您好、Rakesh、

感谢您的回复。现在已经足够了。

此致

Naim

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