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[参考译文] TL431:具有缓冲输出的 TL431

Guru**** 2595805 points
Other Parts Discussed in Thread: TL431, LM117, TL431LI, ATL431LI

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/792158/tl431-tl431-w-buffered-output

器件型号:TL431
主题中讨论的其他器件: LM117

您好!

背景:

我正在设计电平从3.3V 或5.25V 转换为15V、从15V 转换为3.3V 或5.25V 的信号调节电路(用于连接 PXI 数字 I/O 和受测单元(UUT))。 这些连接将在产品内部进行配置、因此我希望在  连接不正确时保护电路的输入免受过压影响。 在低压侧(3.3或5.25) 、我使用的输入电阻器(10k)连接到低电容二极管(2pF)的阳极 、集电极连接到3.3或5.25电源轨。 假设所有输入都被拉至+15V 的最坏情况、我使用的许多通道的每个输入1.15mA 会快速增加。

我想使用 TL431IB 作为其精度、但需要将其输出缓冲为小于200mA 的灌电流。  因此、我设计了一个具有10uF 输出电容的简单 NPN/PNP 推挽式缓冲器、如此处所示。

R2 (100欧姆) 用于在基极/发射极结"关闭"时对输出进行有限控制。

根据 TL431数据表、我相信与 R2串联的输出电容器是可以的。

此外、JP11 、R3和 R5电阻器允许选择3.3或 5.25V 输出。

问题:

是否有任何"危险信号"问题值得我注意?


例如:查看一些稳压器的数据表、建议在某些条件下(例如关闭)使用二极管、如 LM117数据表的以下摘录所示。 这是否是我的电路的问题?

我们将感谢您提出任何建议或警告。

-James

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    尊敬的 James:

    在设计时、我有几个需要考虑的问题。
    我建议使 R1位于较小的一侧、以便正确导通两个晶体管、使器件更稳定。
    我会使 C1变得大。
    电路的主要问题是 C3电容器。 TL431具有稳定区域、非常适合保持在这些区域内。 人们误解了这种稳定性仅与 TL431阴极上的电容器相关。 实际上、稳定性基于 TL431的反馈网络。 在这种情况下、反馈环路为 TL431阴极-> V1/V3 -> FB 电阻器-> TL431 FB 引脚。 决定稳定性的电容器将是 C3电容器。 在此应用中、稳定性区域实际上会减小、因为 TL431 -> V1/V3的每个稳定性区域和放大效果都有影响。 我会使 C3变得非常大或非常小。
    建议使用 TL431LI、因为与典型的 TL431器件相比、该器件上的稳定性区域更小。
    如果您需要 Ika 较低的431器件以实现较小的静态电流、则可以使用 ATL431LI。
    TL431在开启和关闭时没有音乐会。 需要注意的一点是、有时此分立式 LDO 应用确实需要较小的最小输出电流才能实现1mA 的稳压输出、否则电压可能无法稳压。

    -Marcoo
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Marcoo、

    感谢您的指导。

    我进行了一些仿真、选择 R1 = 300 Ω/1W、R2 = 100 Ω 且 C3 = 10uF。 这种组合 似乎效果良好。

    我遇到的一个问题是仿真高速负载变化时。 我完成了一条有关 BJT 内部基极电阻和电容的学习曲线。 我必须找到具有低时间常数的 BJT (即 SPICE 模型中的低 Rb 和低 CJE||CJC)。 具有较高内部 时间常数的晶体管在负载阶跃变化期间产生较大的瞬时电流;这些瞬时"过冲/振铃"电流远远超过器件的安全工作区(SOA)。

    因此、我难以应对的权衡是 找到 一对晶体管、它们产生 的电流过冲/振铃最小 、但具有足够大的 SOA (针对温升和最坏情况运行降低了保守值)、以满足我的电源和电路板空间要求。

    再次感谢您!

    James