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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/807829/tlv62130-snubber-with-tlv62130
电流电路板中的尖峰噪声不小。 我想尝试使用缓冲电路来降低尖峰噪声、但数据表中没有参考。
您认为值得一试吗？ 对此有任何建议吗？
用户好、
您能否更具体地了解您在电路板上观察到的尖峰噪声、您能否与我们分享显示您所面临挑战的波形？
在系统布局上再做一些额外的工作是降低噪声的好做法。
我建议您查看此应用手册 ：http://www.ti.com/lit/an/slyt614/slyt614.pdf
非常感谢！
此致、
Dorian
Dorian、您好！
感谢您的重播。
我认为您害怕探头引起的振铃。 但没关系。 我使用的是具有短引线的有源探头。
尖峰噪声的峰值大于30mV。 它不是很大、但我想减小它。
我计划从4.7欧姆和470pF 开始。
顺便说一下、我有一个问题需要讨论。
我认为 Cout 接地太靠近所附基准中的 Cin 环路。
我同意、从封装的角度来看、这是很好的、但从降噪的角度来看、这是不好的。
你怎么看。
e2e.ti.com/.../e2e_5F00_attach1.pdfe2e.ti.com/.../e2e_5F00_attach2.pdfKoike
您好！
值得一提的是、良好的低电感探测技术对于这些类型的改进至关重要。
由于您计划使用缓冲电路来最大限度地减少振铃、因此您应该阅读以下应用手册：
http://www.ti.com/lit/an/slva255/slva255.pdf
请务必记住、我的电源迹线应该在系统周围看起来是什么样的？ 连接它们的最短方式是什么？
在开关模式电源中、最大限度地减小输入/输出电容器和电感器等每个电源组件之间的路径非常重要。
功率组件之间的迹线越长、流过的电流不可忽略、寄生电感就越大。
保持这些环路较小对于实现器件的最佳运行至关重要。
在这种情况下、Cin 接地和 Cout 接地之间将存在很长的连接。 我建议您缩短此链接。
在这里、您还可以找到有关出色 PCB 布局的五个步骤的优秀应用手册：
http://www.ti.com/lit/an/slyt614/slyt614.pdf
此致、 Dorian
感谢您的回复。 我想我们在同一页上。
感谢您的支持。
Koike
