[参考译文] BQ76920EVM：在 bqStudio 中使用 FET_EN 命令禁用 DSG MOS 和 CHG MOS 后、PACK-和 PACK+的电压也为18.5V。

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器件型号：BQ76920EVM
主题中讨论的其他器件：BQ76920、 BQSTUDIO

我根据文档 slvu924c：bq76920评估模块用户指南来设计电路板

但我发现一个奇怪的现象。

首先，我测量 PACK+和 PACK-的电压，电压为 20.47V，等于电池的电压。

其次、我在 bqStudio 中使用 FET_EN 命令禁用了 DSG MOS 和 CHG MOS。

然后，我测量 PACK+和 PACK-的电压， PACK- 和 PACK+的电压也是18.5V。

DSG MOS 和 CHG MOS 肯定是闭合的、 Vgs 都是0V。

我认为 MOSFET Q3的体二极管会导致该问题。

如果我使用万用表测量电压、则电路回路为 PACK+，my 万用表、R19、R18、R17、 MOSFET Q3的体二极管、CHG 引脚、GND。

我是对的吗？这是正常现象？以及如何解决问题？

7 年多前

0 admin 7 年多前

TI__Guru**** 2493175 points

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您好、Feiyue、
当 CHG 关闭时、它使用1M 拉低至 VSS、以关闭充电 FET。当 DSG 也关断时、上面 FET Q1和 Q2的漏极以及 Q2的源极(PACK-)都可以上拉。在 PACK+和 PACK-之间连接一个仪表会在电池组和具有 CHG 路径电阻的分压器上产生负载。在这种情况下、PACK 端子上的典型预期电压为 Vpack = Vbattery x (Rmeter/(Rmeter/(Rmeter + RCHG_OFF + R18 + R19))或大约16V (10兆欧表和21V 电池)。实际仪表电阻越高、所示的电压越高。

0 admin 7 年多前

TI__Guru**** 2493175 points

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我无法理解您对“当 DSG 也关断时，上面 FET Q1和 Q2的漏极以及 Q2的源极(PACK-)都可以上拉”的解释。 FET Q1的漏极从何处上拉至？什么是电路环路？

这意味着当 CHG 关闭时、CHG 引脚会下拉至 VSS、
在 PACK+和 PACK-之间连接一个仪表后，回路为 BAT+、PACK+、METER、R19、R18、R17、Q3、CHG、GND。我是对的吗？

0 admin 7 年多前

TI__Guru**** 2493175 points

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您好、Feiyue、

也许这是我的措辞不好。电池组-可由连接到端子的任何负载上拉、包括一个仪表。

您对循环的描述似乎很好。 GND 连接到电池-形成环路。查看图片是否通过并有助于：

电源管理（参考译文帖）

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[参考译文] BQ76920EVM：在 bqStudio 中使用 FET_EN 命令禁用 DSG MOS 和 CHG MOS 后、PACK-和 PACK+的电压也为18.5V。